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fpga設(shè)計(jì)

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門(mén)陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。

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fpga設(shè)計(jì)技術(shù)

使用Xilinx口袋實(shí)驗(yàn)平臺(tái),動(dòng)手FPGA設(shè)計(jì)！

以Xilinx公司最新的Vivado FPGA集成開(kāi)發(fā)環(huán)境為基礎(chǔ)，將數(shù)字邏輯設(shè)計(jì)與硬件描述語(yǔ)言Verilog HDL相結(jié)合，循序漸進(jìn)地介紹了基于Xili...

2017-12-27 標(biāo)簽：fpga FPGA設(shè)計(jì)xilinx 1.5萬(wàn) 0

FPGA設(shè)計(jì)需要注意哪些要點(diǎn)

FPGA的用處比我們平時(shí)想象的用處更廣泛，原因在于其中集成的模塊種類(lèi)更多，而不僅僅是原來(lái)的簡(jiǎn)單邏輯單元（LE）。早期的FPGA相對(duì)比較簡(jiǎn)單，所有的功能...

2018-09-07 標(biāo)簽：fpga FPGA設(shè)計(jì) 1.3萬(wàn) 0

FPGA設(shè)計(jì)思想，速度和面積互換原則不可忽視

流水線設(shè)計(jì)可以從某種程度上提高系統(tǒng)頻率。。前提是：設(shè)計(jì)可以分為若干步驟進(jìn)行處理，而且整個(gè)數(shù)據(jù)處理的過(guò)程是單向的，即沒(méi)有反饋或者逆運(yùn)算、前一個(gè)步驟的輸出是...

2017-12-18 標(biāo)簽：fpga FPGA設(shè)計(jì)可編程邏輯 1.1萬(wàn) 0

探討基于sopc技術(shù)的fpga集成嵌入式系統(tǒng)設(shè)計(jì)

可編程片上系統(tǒng)( SoPC)是在可編程邏輯器件的基礎(chǔ)上發(fā)展起來(lái)的一種靈活、高效的嵌入式系統(tǒng)設(shè)計(jì)解決方案,系統(tǒng)設(shè)計(jì)者可以從傳統(tǒng)的板級(jí)系統(tǒng)設(shè)計(jì)轉(zhuǎn)換到芯片級(jí)系...

2017-12-02 標(biāo)簽：FPGA設(shè)計(jì)SOPC技術(shù) 7697 0

介紹FPGA在線調(diào)試的一大利器—VIO

之前的文章介紹了FPGA在線調(diào)試的方法，包括選定抓取信號(hào)，防止信號(hào)被優(yōu)化的方法等等。

2023-06-20 標(biāo)簽：FPGA設(shè)計(jì)DDS 觸發(fā)器 7284 0

基于單光子探測(cè)的時(shí)間相關(guān)計(jì)數(shù)TCSPC設(shè)計(jì)實(shí)現(xiàn)

TCSPC時(shí)間相關(guān)單光子計(jì)數(shù)技術(shù)是一種成熟且通用的單光子計(jì)數(shù)技術(shù)，是一種功能強(qiáng)大的分析方法，目前廣泛應(yīng)用于熒光壽命測(cè)量、時(shí)間分辨光譜、熒光壽命成像、飛行...

2023-09-22 標(biāo)簽：FPGA設(shè)計(jì)存儲(chǔ)器數(shù)字轉(zhuǎn)換器 6962 3

你一定想知道FPGA的那些事...

作者：張澤小腳丫STEP 導(dǎo)讀：FPGA（Field Programmable Gate Array）譯作中文為：現(xiàn)場(chǎng)可編程門(mén)陣列，也就是設(shè)計(jì)者可以在現(xiàn)...

2018-06-14 標(biāo)簽：fpga FPGA設(shè)計(jì)Altera 6944 0

基于FPGA自適應(yīng)數(shù)字頻率計(jì)的設(shè)計(jì)

在電子工程，資源勘探，儀器儀表等相關(guān)應(yīng)用中，頻率計(jì)是工程技術(shù)人員必不可少的測(cè)量工具。頻率測(cè)量也是電子測(cè)量技術(shù)中最基本最常見(jiàn)的測(cè)量之一。不少物理量的測(cè)量，...

2019-01-01 標(biāo)簽：FPGA設(shè)計(jì) 6749 0

ISE中ChipScope使用教程

ChipScope是Xilinx提供的一個(gè)校驗(yàn)FPGA設(shè)計(jì)的工具。它的本質(zhì)是一個(gè)虛擬的邏輯分析儀，能調(diào)用FPGA內(nèi)部的邏輯資源對(duì)代碼中的各個(gè)變量進(jìn)行抓取分析。

2023-05-08 標(biāo)簽：FPGA設(shè)計(jì)led燈 ROM 6613 0

FPGA設(shè)計(jì)的十五條原則詳細(xì)解析

1、硬件設(shè)計(jì)基本原則 (1)速度與面積平衡和互換原則：一個(gè)設(shè)計(jì)如果時(shí)序余量較大，所能跑的頻率遠(yuǎn)高于設(shè)計(jì)要求，能可以通過(guò)模塊復(fù)用來(lái)減少整個(gè)設(shè)計(jì)消耗的...

2017-12-19 標(biāo)簽：fpga FPGA設(shè)計(jì) 6465 0

使用SoM來(lái)開(kāi)發(fā)嵌入式系統(tǒng)的優(yōu)勢(shì)

作者：Steve Leibson 很多嵌入式設(shè)計(jì)使用基于微處理器和微控制器的單板計(jì)算機(jī) (SBC) 和系統(tǒng)級(jí)模塊 (SoM)（例如，請(qǐng)參閱使用 Rasp...

2018-08-31 標(biāo)簽：嵌入式 FPGA設(shè)計(jì)soc 5888 0

FPGA設(shè)計(jì)中BRAM的知識(shí)科普

FPGA設(shè)計(jì)中，BRAM是一項(xiàng)非常關(guān)鍵的內(nèi)置存儲(chǔ)資源，F(xiàn)PGA開(kāi)發(fā)需要熟練使用BRAM，今天再?gòu)?fù)習(xí)一下BRAM的知識(shí)，包括BRAM的定義、組成、應(yīng)用等等。

2023-08-15 標(biāo)簽：fpga DRAM FPGA設(shè)計(jì) 5743 0

FPGA仿真必備—Matlab生成.mif/.txt/.coe文件

.mif 和 .coe 是 FPGA 設(shè)計(jì)中常用的存儲(chǔ)文件，用于 ROM、RAM 等存儲(chǔ)器數(shù)據(jù)的加載，常見(jiàn)的還用在 DDS 信號(hào)發(fā)生器和 FIR 濾波器...

2023-06-21 標(biāo)簽：FPGA設(shè)計(jì)存儲(chǔ)器 DDS 5657 0

什么是ECO？ECO的應(yīng)用場(chǎng)景和實(shí)現(xiàn)流程

ECO指的是 Engineering Change Order ，即工程變更指令。目的是為了在設(shè)計(jì)的后期，快速靈活地做小范圍修改，從而盡可能的保持已經(jīng)驗(yàn)...

2023-04-23 標(biāo)簽：dsp FPGA設(shè)計(jì)IC設(shè)計(jì) 5479 0

BGA如何快速在4個(gè)Ball之間均勻布孔扇出呢？

BGA扇出是EDA工程師的一項(xiàng)基本功，在布局完成后，先將BGA的Ball進(jìn)行打孔扇出，然后分層和4個(gè)方向?qū)GA內(nèi)部信號(hào)線引出到外部空間

2023-09-22 標(biāo)簽：PCB板 FPGA設(shè)計(jì)BGA封裝 5352 0

在FPGA設(shè)計(jì)中可以用LUT組建分布式的RAM

舉一個(gè)簡(jiǎn)單的例子，如果要實(shí)現(xiàn)一個(gè)6*1的mux可以用一個(gè)6輸入的LUT或者是2個(gè)4輸入的LUT來(lái)實(shí)現(xiàn)，6輸入的LUT相當(dāng)于是6位地址線一位數(shù)據(jù)位，能夠存...

2022-05-13 標(biāo)簽：FPGA設(shè)計(jì)RAM 分布式 5236 0

FPGA設(shè)計(jì)中的復(fù)位

本系列整理數(shù)字系統(tǒng)設(shè)計(jì)的相關(guān)知識(shí)體系架構(gòu)，為了方便后續(xù)自己查閱與求職準(zhǔn)備。在FPGA和ASIC設(shè)計(jì)中，對(duì)于復(fù)位這個(gè)問(wèn)題可以算是老生常談了，但是也是最容易...

2023-05-12 標(biāo)簽：fpga FPGA設(shè)計(jì)觸發(fā)器 4978 0

testbench是什么? testbench測(cè)試的機(jī)制是什么?

廢話(huà)不多說(shuō)直接上干貨，testbench就是對(duì)寫(xiě)的FPGA文件進(jìn)行測(cè)試的文件，可以是verilog也可以是VHDL。

2023-06-28 標(biāo)簽：FPGA設(shè)計(jì)交換機(jī)VHDL語(yǔ)言 4956 0

FPGA數(shù)字鐘方案設(shè)計(jì)

采用FPGA進(jìn)行的數(shù)字電路設(shè)計(jì)具有更大的靈活性和通用性，已成為目前數(shù)字電路設(shè)計(jì)的主流方法之一。

2019-07-24 標(biāo)簽：FPGA設(shè)計(jì)數(shù)字電路 4914 0

Vivado增量編譯的基本概念、優(yōu)點(diǎn)、使用方法以及注意事項(xiàng)

隨著FPGA設(shè)計(jì)的復(fù)雜度不斷提高，設(shè)計(jì)人員需要選擇更為高效的設(shè)計(jì)流程來(lái)保證開(kāi)發(fā)效率和減少開(kāi)發(fā)成本。其中，Vivado增量編譯是一種非常重要的設(shè)計(jì)流程。本...

2023-05-25 標(biāo)簽：fpga FPGA設(shè)計(jì)時(shí)序 4859 0

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Protues

Protues

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Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

Altium Designer

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FPGA芯片

FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門(mén)陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

ArduBlock

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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門(mén)檻降低，即使沒(méi)有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫(xiě)程序。
AD10

AD10

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識(shí)別

識(shí)別

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FPGA開(kāi)發(fā)板

FPGA開(kāi)發(fā)板

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FPGA開(kāi)發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來(lái)實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車(chē)工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過(guò)去汽車(chē)電子產(chǎn)品的開(kāi)發(fā)周期是漫長(zhǎng)的，而許多汽車(chē)制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車(chē)。
PCB封裝

PCB封裝

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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤(pán)的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來(lái)，以便可以在畫(huà)pcb圖時(shí)進(jìn)行調(diào)用。
QUARTUS II

QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開(kāi)發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
PCB封裝庫(kù)

PCB封裝庫(kù)

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語(yǔ)音交互

語(yǔ)音交互

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AD09

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PDN

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QuickPcb

QuickPcb

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Artix-7

Artix-7

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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿(mǎn)足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
VHDL代碼

VHDL代碼

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Protel 99 se

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powerlink

powerlink

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candence

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面包板

面包板

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面包板是由于板子上有很多小插孔，專(zhuān)為電子電路的無(wú)焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
特性阻抗

特性阻抗

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特性阻抗又稱(chēng)特征阻抗，它不是直流電阻，屬于長(zhǎng)線傳輸中的概念。特性阻抗是射頻傳輸線影響無(wú)線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱(chēng)阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
AXI

AXI

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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫(xiě)數(shù)據(jù)通道、并支持Outstanding傳輸訪問(wèn)和亂序訪問(wèn)，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
驅(qū)動(dòng)電流

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時(shí)鐘源

時(shí)鐘源

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時(shí)鐘源用來(lái)為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門(mén)組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
FPGA教程

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AD采樣

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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
Kintex-7

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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性?xún)r(jià)比提高了一倍，功耗降低了一半。
Protel DXP

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紅外觸摸屏

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