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任意偶數的分頻器設計

所謂“分頻”，就是把輸入信號的頻率變成成倍數地低于輸入頻率的輸出信號。

2023-06-05 標簽：驅動器分頻器計數器 1459 0

信號協議中同步傳輸和異步傳輸有什么區別

在信號協議中，有非常多的種類，如UART，I2C，SPI，PCIe等等，它們有自己的一套制定規則，但是在協議制定中，一定需要在同步和異步中選擇其中一項作...

2023-11-07 標簽：uart 同步傳輸時鐘信號 1455 0

JESD204B具體調試過程

說的是一塊數字采集板的調試，主要器件也不多，主要是公司的ADC，ADI的時鐘芯片和Xilinx的FPGA，還有一些DC-DC和LDO。

2022-11-18 標簽：fpga ldo DC-DC 1421 0

什么是自動時鐘門控結構呢？關于自動時鐘門控的解析

每次作為面試官問一些RTL功耗優化的問題時候，都會希望聽到一個答案：優化了RTL的clk-gating比例。

2023-12-04 標簽：寄存器 RTL 觸發器 1406 0

編寫一個創建模塊dut實例的測試平臺

編寫一個創建模塊dut實例（具有任何實例名稱）的測試平臺，并創建一個時鐘信號來驅動模塊的clk輸入。時鐘周期為 10 ps。時鐘應初始化為零，其第一個轉...

2023-03-13 標簽：Verilog HDL 時鐘信號 1388 0

FPGA時序分析-建立時間和保持時間裕量都是inf怎么解決呢？

今天有個小伙伴遇到一個問題，就是在vivado里面綜合后看到的建立時間和保持時間裕量都是inf，我們來看看怎么解決這個問題。

2023-07-30 標簽：fpga FPGA設計寄存器 1365 0

從鎖存器角度看亞穩態發生的原因及方案簡單分析

發生亞穩態的原因是信號在傳輸的過程中不能滿足觸發器的建立時間和保持時間。

2023-06-20 標簽：鎖存器觸發器 FIFO存儲 1363 0

復位消抖電路具體長什么樣子呢？

復位信號在使用前一般需要進行消抖處理，也稱為復位濾毛刺。復位的抖動可能會導致芯片產生多次復位動作，給系統帶來不確定性和誤差。

2023-12-04 標簽：D觸發器延時器 CLK 1355 0

聊聊使用Verdi去分析NBA Delay的問題

NBA 就是 NonBlocking Assignment，非阻塞賦值的縮寫。它通常用來描述一個用時鐘沿觸發的寄存器。

2023-06-09 標簽：寄存器仿真器 VCS 1352 0

怎么設計一個32bit浮點的加法器呢？

設計一個32bit浮點的加法器，out = A + B，假設AB均為無符號位，或者換個說法都為正數。

2023-06-02 標簽：C語言加法器 CLK 1345 0

使用OSERDES發送高速串行數據

OSERDES實現并串轉換，只需要管發送并不需要管接收到的數據如何，所以它的操作相對于ISERDES來說簡單；

2023-06-16 標簽：FPGA設計 DDR SDR 1294 0

介紹一下奇數分頻器的設計

入門從簡單開始，先來個三分頻分析一下。三分頻其實就是把輸入時鐘的三個周期當作一個周期，具體波形如圖所示。

2023-06-05 標簽：分頻器計數器觸發器 1292 0

寫assertion很痛苦？了解一下SVA Checker Library

請根據這段代碼寫一個assertion檢查 count 每次加5。

2023-08-12 標簽：VCS SVA FIFO存儲 1222 0

如果IP已經采用OOC綜合那么是否可以將其修改為Global綜合方式？

相比于Project模式，Vivado Non-Project模式可以提供用戶更多的控制權，進而用戶可以自主管理整個編譯流程

2023-11-16 標簽：fifo CLK Vivado 1205 0

Verilog除法器設計

取被除數的高幾位數據，位寬和除數相同（實例中是 3bit 數據）。

2023-05-30 標簽：寄存器 Verilog 除法器 1189 0

Easier UVM Code Generator Part 4:生成層次化的驗證環境

本文使用Easier UVM Code Generator生成包含多個agent和interface的uvm驗證環境。

2023-06-06 標簽：UVM 生成器 CLK 1189 0

帶skew的時序計算基礎分析

組合邏輯的延遲Tc，從FF1/CK到FF1/Q的延遲為Tq，定義Treal = Tq + Tc，從建立時間和保持時間這兩個標準去考察Treal。

2023-12-01 標簽：RTL 觸發器時序分析 1173 0

為什么要用Serdes？

在芯片內部，信號一般都是通過并行傳輸的，因為串行傳輸實在是太慢了。

2023-09-01 標簽：CLK I2C協議 ADC采樣 1168 0

所有的單比特信號跨時鐘域都可以用敲兩級DFF的辦法處理嗎？

用敲兩級DFF的辦法（兩級DFF同步器）可以實現單比特信號跨時鐘域處理。但你或許會有疑問，是所有的單比特信號跨時鐘域都可以這么處理嗎？

2023-06-28 標簽：信號處理器同步器 CLK 1136 0

SaberRD狀態機建模工具介紹（二）狀態機建模工具使用示例

假設電阻阻值為r_normal，首先打開狀態機建模工具，添加電阻端口，電阻端口包含貫通變量電流和跨接變量電壓，使用分支型端口。

2023-12-05 標簽：可變電阻狀態機交流電壓 1090 0

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