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StarRC LEF DEF flow錯(cuò)誤Debug經(jīng)驗(yàn)分享

jf_tpHP8OJR ? 來源:集成電路設(shè)計(jì)及EDA教程 ? 2023-04-20 09:24 ? 次閱讀

在研究生階段曾流過很多次片,感覺后端設(shè)計(jì)中最關(guān)鍵的就是后端Flow了,尤其是PR階段,與PR相比,綜合階段的腳本就簡(jiǎn)單太多了。

為了實(shí)現(xiàn)流片,當(dāng)時(shí)從零開始搭了從RTL一直到GDS還有signoff、DFT...的完整flow,中間曾發(fā)現(xiàn)過一些非常Critical的Flow bug或者工藝上一些非常值得注意的點(diǎn),感覺非常嚇人,因?yàn)檫@些很可能導(dǎo)致芯片變成磚頭,幾十萬的流片費(fèi)很可能就打水漂了。

個(gè)人覺得沒有Bug的Flow是不可能存在的,無非是它的影響大小的問題,所幸的是當(dāng)時(shí)的流片都成功了。雖然基于當(dāng)時(shí)開發(fā)的Flow設(shè)計(jì)出的芯片流片測(cè)試得到的結(jié)果是成功的,可是隨著認(rèn)知的深入,發(fā)現(xiàn)其實(shí)之前研究生階段開發(fā)的Flow還是有一些問題的,也有很多可以優(yōu)化的空間,比如可以進(jìn)一步提高Flow的可重用性以及靈活性。再比如Signoff的時(shí)候都應(yīng)該Check哪些東西(非常關(guān)鍵),這些內(nèi)容在來了Nvidia之后,發(fā)現(xiàn)需要Check的東西蠻多的,當(dāng)時(shí)研究生的時(shí)候signoff的內(nèi)容不夠完整。

尤其是signoff的時(shí)候一些input file的準(zhǔn)確性如何去保證,這個(gè)非常關(guān)鍵,因?yàn)槿绻鹖nput file本身就存在一些問題的話,那么你signoff的結(jié)果即使是PASS的,那么也是沒有意義的。之前公司里面也發(fā)現(xiàn)了一個(gè)會(huì)影響RC / Timing signoff的Bug,它并沒有被其他任何的signoff Check所抓出來,因此感覺問題非常恐怖,深感后端需要注意的東西非常多,一定要小心,多持懷疑態(tài)度!!。

另外,在研究生的時(shí)候,也有發(fā)現(xiàn)Foundary提供的某些輸入文件之間不是特別的Match(其實(shí)可以寫一些腳本來自動(dòng)check),這里分享一個(gè)StarRC跑LEF DEF flow的時(shí)候遇到的一個(gè)例子以及Debug的步驟與經(jīng)驗(yàn)。

Foundary提供的RC提取文件有以下幾個(gè):

67a27450-deb8-11ed-bfe3-dac502259ad0.png

Sample_map文件內(nèi)容如下:

67b6d40e-deb8-11ed-bfe3-dac502259ad0.png

DEF文件和nxtgrd文件如下:

67eeea4c-deb8-11ed-bfe3-dac502259ad0.png

顯然是不能用上面的那個(gè)Mapping file的。

而上面那個(gè)Mapping file是給itf2tluplus轉(zhuǎn)換用的!!!

那么StarRC的這個(gè)Mapping file應(yīng)該怎么寫呢?





審核編輯:劉清

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原文標(biāo)題:StarRC LEF DEF flow錯(cuò)誤Debug經(jīng)驗(yàn)分享

文章出處:【微信號(hào):集成電路設(shè)計(jì)及EDA教程,微信公眾號(hào):集成電路設(shè)計(jì)及EDA教程】歡迎添加關(guān)注!文章轉(zhuǎn)載請(qǐng)注明出處。

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