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標簽 > xilinx
Xilinx是全球領先的可編程邏輯完整解決方案的供應商。Xilinx研發、制造并銷售范圍廣泛的高級集成電路、軟件設計工具以及作為預定義系統級功能的IP(Intellectual Property)核。
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VHDL和verilog各有優點,選擇一個,建議選擇verilog。熟練使用設計軟件,知道怎樣編譯、仿真、下載等過程。起步階段不希望報一些培訓班,除非你...
Xilinx首次亮相的Virtex UltraScale+ HBM FPGA
隨著人工智能、5G通信、大數據、云計算等應用的出現,人們對于通信帶寬的要求也在不斷的提高,這些應用需要高吞吐、低延遲、高密度部署等特性,傳統的DDR S...
針對Linux BSP開發的Petalinux,如何實現硬件工程導入
本實驗工程將介紹如何利在賽靈思異構多處理器產品系列 Zynq UtralScale+ MPSoC ZCU102 嵌入式評估板上實現多個 UIO,同時借...
Xilinx支持Serial RapidIO Gen2核可應用在Rapid IO交換設計中
Rapid IO協議由于無主機,且各設備之間可以并行交換信息,所以廣泛應用于對交換速率要求高,且交互復雜的應用中。Xilinx現在有支持Serial R...
Xilinx基于ARM的Zynq-7000和Zynq UltraScale+ MPSoC及RFSoC器件是否存在安全漏洞
本文試圖搞清楚在 Xilinx 基于 ARM 的 Zynq-7000、Zynq UltraScale+ MPSoC 和 Zynq UltraScale+...
Xilinx IP核配置,一步一步驗證Xilinx Serdes GTX最高8.0Gbps
之前用serdes一直都是跑的比較低速的應用,3.125Gbps,按照官方文檔一步一步來都沒出過什么問題,這次想驗證一下K7系列GTX最高線速8Gbps...
基于SRL16的分布式RAM不再支持V5、S6和V6等器件,但是SRL16是所有XIlinx器件都支持的,并且在設計中應用非常頻繁,因此可通過調用原語的...
傳統的源同步傳輸,時鐘和數據分離。在速率比較低時(1000M),沒有問題。 在速率越來越高時,這樣會有問題 由于傳輸線的時延不一致和抖動存在,接收端不能...
Xilinx的方案有現成的參考設計XAPP485/486.后來調試了一下,總是發現圖像邊緣地方部分區域是亮的,后來lvds的并上匹配電阻后,顯示就OK了...
或許,你會認為DPDK(Data Plan Development Kit)是一個應用在網絡應用層上的高速數據傳輸標準;或許,你認為DPDK是Intel...
OLOGIC 資源 OLOGIC塊在FPGA內的位置緊挨著IOB,其作用是FPGA通過IOB發送數據到器件外部的專用同步塊。OLOGIC 資源的類型有O...
2018-04-25 標簽:xilinx 3506 0
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