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賽靈思技術(shù)

Zynq-7045的功能介紹

Xilinx的新視頻展示了幾種Zynq-7045功能。

2018-11-21 標(biāo)簽：汽車電子賽靈思邏輯 2.1萬 0

FPGA設(shè)計小Tips：如何正確使用FPGA的時鐘資源

賽靈思在其FPGA中提供了豐富的時鐘資源，大多數(shù)設(shè)計人員在他們的FPGA設(shè)計中或多或少都會用到。不過對FPGA設(shè)計新手來說，什么時候用DCM、PLL、P...

2013-07-23 標(biāo)簽：FPGA 賽靈思 PLL 2.0萬 0

玩轉(zhuǎn)賽靈思Zedboard開發(fā)板（6）:如何在Zedboard上運行l(wèi)inux下的應(yīng)用程序？

電子發(fā)燒友網(wǎng)編輯現(xiàn)為讀者整合《玩轉(zhuǎn)賽靈思Zedboard開發(fā)板》系列文章，其中包括在ZedBoard開發(fā)板上的一些應(yīng)用實例。本文主要講述Zedboar...

2013-01-24 標(biāo)簽：賽靈思 linux FPGA開發(fā)板 1.7萬 2

基于賽靈思FPGA的低成本MIPI接口IP

基于FPGA的低成本MIPI接口，專門針對視頻顯示器和攝像頭的。設(shè)計嵌入式系統(tǒng)DSI和CSI-2視頻接口的用戶現(xiàn)在即可采用低成本MIPI接口

2017-02-10 標(biāo)簽：FPGA 賽靈思 MIPI 1.7萬 0

Xilinx軟件命令行工具：XSCT開發(fā)和調(diào)試

了解如何使用XSCT，Xilinx軟件命令行工具進行開發(fā)和調(diào)試。該視頻演示了XSCT如何充當(dāng)Xilinx SDK的命令行控制臺。

2018-11-21 標(biāo)簽：賽靈思調(diào)試 sdk 1.4萬 0

賽靈思FPGA全局時鐘網(wǎng)絡(luò)結(jié)構(gòu)詳解

針對不同類型的器件，Xilinx公司提供的全局時鐘網(wǎng)絡(luò)在數(shù)量、性能等方面略有區(qū)別，下面以Virtex-4系列芯片為例，簡單介紹FPGA全局時鐘網(wǎng)絡(luò)結(jié)構(gòu)。

2013-11-28 標(biāo)簽：FPGA 賽靈思頻譜合成器 1.3萬 0

玩轉(zhuǎn)賽靈思Zedboard開發(fā)板（3）：基于Zynq PL的流水燈

電子發(fā)燒友網(wǎng)核心提示：本文為玩轉(zhuǎn)賽靈思Zedboard開發(fā)板（3）：基于Zynq PL的流水燈，內(nèi)容精彩，敬請對電子發(fā)燒友網(wǎng)保持密切關(guān)注。基于Zynq ...

2012-12-05 標(biāo)簽：賽靈思流水燈 Zynq 1.3萬 0

如何利用LUT來實現(xiàn)FPGA中的DSP功能

查找表 (LUT) 實質(zhì)上是一個存儲元件，能夠根據(jù)任何給定的輸入狀態(tài)組合，“查找”輸出，以確保每個輸入都有確切的輸出。采用LUT來實現(xiàn) DSP功能具有一...

2018-07-02 標(biāo)簽：dsp fpga 賽靈思 1.3萬 0

Xilinx的HDMI 1.4Tx/Rx和HDMI 2.0Tx/Rx的IP內(nèi)核介紹

Xilinx的HDMI 1.4 Tx / Rx和HDMI 2.0 Tx / Rx的IP內(nèi)核將采用最新發(fā)布的inrevium AMERICA FMC HD...

2018-11-28 標(biāo)簽：內(nèi)核賽靈思 ip 1.3萬 0

技巧分享：如何在Vivado中正確使用接口

設(shè)計技巧：在 Vivado Synthesis 中使用 SystemVerilog 接口連接邏輯

2019-07-02 標(biāo)簽：賽靈思 Vivado 1.2萬 0

玩轉(zhuǎn)賽靈思Zedboard開發(fā)板（5）:基于AXI Lite總線的從設(shè)備IP設(shè)計

本小節(jié)通過使用XPS中的定制IP向?qū)?ipwiz)，為已經(jīng)存在的ARM PS 系統(tǒng)添加用戶自定IP(Custom IP )，了解AXI Lite IP基...

2012-12-23 標(biāo)簽：ARM 賽靈思 IP核 1.2萬 1

數(shù)據(jù)中心使用 DCI 這樣的技術(shù)使之間的互連變得越來越緊密

為支持數(shù)據(jù)中心間的通信，需要使用非常大的數(shù)據(jù)管道，同時，用于在這些管道間傳輸數(shù)據(jù)的網(wǎng)絡(luò)通常稱為數(shù)據(jù)中心互連 (DCI)。

2018-02-03 標(biāo)簽：賽靈思數(shù)據(jù)中心可編程邏輯 1.2萬 0

如何使用High Speed SelectIO向?qū)墒纠齀O環(huán)回演示

本視頻介紹了如何使用UltraScale / UltraScale +本機模式High Speed SelectIO向?qū)墒纠齀O環(huán)回設(shè)計。針對T...

2018-11-22 標(biāo)簽：io 賽靈思模式 1.1萬 0

如何使用Xilinx SDK創(chuàng)建Linux應(yīng)用程序，并進行開發(fā)和調(diào)試

了解如何使用Xilinx SDK創(chuàng)建Linux應(yīng)用程序。我們還將重點介紹和演示支持Linux應(yīng)用程序開發(fā)和調(diào)試的不同方面的SDK功能。整個過程快...

2018-11-20 標(biāo)簽：賽靈思 linux 應(yīng)用程序 1.1萬 0

Xilinx GTX（12.5 Gb/s）收發(fā)器功能演示

Xilinx GTX（12.5 Gb / s）收發(fā)器與SFP +和10G背板一起運行。

2018-11-30 標(biāo)簽：收發(fā)器賽靈思 sfp 1.0萬 0

玩轉(zhuǎn)賽靈思Zedboard開發(fā)板（4）：如何使用自帶外設(shè)IP讓ARM PS訪問FPGA？

本文的目的是使用XPS為ARM PS 處理系統(tǒng)添加額外的IP。從IP Catalog 標(biāo)簽添加GPIO，并與ZedBoard板子上的8個LED燈相連。當(dāng)...

2012-12-16 標(biāo)簽：ARM 賽靈思 IP核 9913 0

Spartan-6 開發(fā)套件詳解

這個Scarab Hardware的miniSpartan6+板的LX9版本現(xiàn)在的價格是75美元（僅僅比Kickstarter 打完折后的價錢69美元多...

2019-08-01 標(biāo)簽：賽靈思 Spartan-6 9155 0

沒有直接可用的Pmod驅(qū)動？傳授你一招填坑秘籍

為了實現(xiàn)這一點我們需要閱讀官方的Pmod接口標(biāo)準(zhǔn)文檔來確保SPI管腳與Pmod橋輸入管腳之間正確的映射。

2018-01-17 標(biāo)簽：賽靈思傳感模塊 Pmod驅(qū)動 9008 0

PCW的基礎(chǔ)知識概述

了解如何從針對Xilinx新Zynq Ultrascale + MPSoC的Vivado設(shè)計套件訪問處理系統(tǒng)配置向?qū)В≒CW），以及如何熟悉PCW的基礎(chǔ)...

2018-11-29 標(biāo)簽：賽靈思配置 vivado 8861 0

利用reVISION? 堆棧實現(xiàn)應(yīng)用算法

監(jiān)控系統(tǒng)嚴重依靠嵌入式視覺系統(tǒng)提供的功能加速在廣泛市場和系統(tǒng)中的部署。這些監(jiān)控系統(tǒng)的用途非常廣泛，包括事件和流量監(jiān)控、安全與安防用途、ISR 和商業(yè)智能...

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