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時序

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這里所說的時序其實就是指時序圖，又名序列圖、循序圖、順序圖，是一種UML交互圖。它通過描述對象之間發(fā)送消息的時間順序顯示多個對象之間的動態(tài)協(xié)作。

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時序技術(shù)

分析和預(yù)測時序數(shù)據(jù)的主要方法,如何使用Python處理時序數(shù)據(jù)

讓我們從一個樸素的假設(shè)開始——“明天會和今天一樣”，但是我們并不使用類似y^t=y(t-1)這樣的模型（這其實是一個適用于任意時序預(yù)測問題的很好的基線，...

2018-09-04 標(biāo)簽：函數(shù)時序 Python 2.9萬 0

時序約束中一種特殊的情景分析

在做模塊級綜合的時候，對于IO路徑一般會使用60%的端口時鐘進行約束，如果這樣的路徑涉及到feedthrough path，也就是INPUT->REG的...

2018-08-21 標(biāo)簽：電路時序 1.1萬 0

繞等長更快的操作方法

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2018-07-20 標(biāo)簽：相位時序 4933 0

分享上海交通大學(xué)團隊在兩項競賽任務(wù)中的算法思路和方案

在時序動作定位問題中，mean Average Precision (mAP) 是最常用的評估指標(biāo)。此次競賽計算0.5到0.95, 以0.05為步長的多...

2018-07-04 標(biāo)簽：網(wǎng)絡(luò)時序計算機視覺 4330 0

對比ARM、DSP，深入了解FPGA

自1985年首款FPGA誕生以來，F(xiàn)PGA已經(jīng)是一名在電子信息領(lǐng)域征戰(zhàn)了30年的老兵，這名戰(zhàn)功赫赫的老兵如今已經(jīng)正式開赴了一個新的戰(zhàn)場。但是FPGA并不...

2018-05-18 標(biāo)簽：fpga 時序 6456 0

FPGA時序約束簡介

在簡單電路中，當(dāng)頻率較低時，數(shù)字信號的邊沿時間可以忽略時，無需考慮時序約束。但在復(fù)雜電路中，為了減少系統(tǒng)中各部分延時，使系統(tǒng)協(xié)同工作，提高運行頻率，需要...

2018-03-30 標(biāo)簽：FPGA 時序 1.5萬 0

時序分析基本概念介紹——花一樣的“模式”

SE是scan enable信號，它控制著scan cell的工作模式。從圖中可以看出，SE，SI，D端通過一個Mux實現(xiàn)工作模式的切換。當(dāng)SE輸入為0...

2018-03-26 標(biāo)簽：DFT 時序 1.4萬 0

ECO填充工具帶來不一樣的IC設(shè)計

集成電路（IC）設(shè)計團隊通常在預(yù)定最后送交制造（tapeout）期限臨近時承受著巨大的壓力。更糟糕的是，他們往往還面臨著后期工程變更命令（Engi...

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詳細分析高速通信和數(shù)據(jù)中心的時序要求以及時鐘振蕩器解決方案

為此，Silicon Labs提供了全新有源時鐘振蕩器，其采用第四代 DSPLL 技術(shù)驅(qū)動，有效解決了 25/40/50/100/400Gbps 時序問...

2018-01-26 標(biāo)簽：數(shù)據(jù)中心時序時鐘振蕩器 7951 0

關(guān)于FPGA時序以及時序收斂的基本概念詳解

FPGA器件的需求取決于系統(tǒng)和上下游（upstream and downstrem）設(shè)備。我們的設(shè)計需要和其他的devices進行數(shù)據(jù)的交互，其他的d...

2018-07-11 標(biāo)簽：FPGA 時序 9641 0

詳細介紹時序基本概念Timing arc

時序分析基本概念介紹——Timing Arc

2018-01-02 標(biāo)簽：時序時序弧 2.4萬 0

基于LCD1602單片機通信時序的問題解析

所謂“時序”從字面意義上來理解，一是“時間問題”，二是“順序問題”。

2017-12-25 標(biāo)簽：時序 lcd1602 9439 0

做嵌入式系統(tǒng)開發(fā)，少不了數(shù)電模電的知識

做嵌入式系統(tǒng)開發(fā)，經(jīng)常要接觸硬件。做嵌入式開發(fā)對數(shù)字電路和模擬電路要有一定的了解。這樣才能深入的研究下去。下面我們簡單的介紹嵌入式開發(fā)中的一些硬件相關(guān)的知識。

2017-12-01 標(biāo)簽：譯碼器嵌入式開發(fā)時序 1.4萬 0

采用FPGA設(shè)計科學(xué)級CCD相機時序發(fā)生器

科學(xué)級CCD相機一般由高速CCD感光芯片、視頻信號處理器、時序控制器、時序發(fā)生器、時序驅(qū)動器、外部光學(xué)成像系統(tǒng)等部分組成，本文分析了IL-E2型TDI-...

2017-11-24 標(biāo)簽：fpga ccd FPGA設(shè)計 2239 0

什么是單片機的時序

計算機每訪問一次存儲器的時間我們把它稱為一個機器周期，它是一個時間基準(zhǔn)，就象我們?nèi)粘Ｉ钪惺褂玫拿胍粯樱嬎銠C中一個機器周期包括12個振蕩周期。

2017-11-17 標(biāo)簽：單片機時序 2326 0

如何利用FPGA進行時序分析設(shè)計

FPGA（Field-Programmable Gate Array），即現(xiàn)場可編程門陣列，它是作為專用集成電路（ASIC）領(lǐng)域中的一種半定制電路而出現(xiàn)...

2017-06-21 標(biāo)簽：fpga 抖動時序 8019 0

影響FPGA設(shè)計周期生產(chǎn)力的最大因素是什么？

提高FPGA設(shè)計生產(chǎn)力的工具、技巧和方法，9影響FPGA設(shè)計周期生產(chǎn)力的最大因素是什么？

2017-02-11 標(biāo)簽：FPGA FPGA設(shè)計時序 681 0

靜態(tài)時序分析基礎(chǔ)與應(yīng)用連載（3）

假設(shè)前級Flip-Flop的訊號由1變0，計算第2條Path終點的AT。

2017-02-11 標(biāo)簽：時序靜態(tài)時序 938 0

靜態(tài)時序分析基礎(chǔ)與應(yīng)用連載（2）

除了Clock之外，對于電路其他輸出輸入端點及其周邊的環(huán)境（Boundary Condition）也要加以描述。

2017-02-11 標(biāo)簽：時序靜態(tài)時序 974 0

靜態(tài)時序分析基礎(chǔ)與應(yīng)用連載（1）

在制程進入深次微米世代之后，晶片（IC）設(shè)計的高復(fù)雜度及系統(tǒng)單晶片（SOC）設(shè)計方式興起。

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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長線傳輸中的概念。特性阻抗是射頻傳輸線影響無線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會阻礙交變電流的流動，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
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庫文件是計算機上的一類文件，提供給使用者一些開箱即用的變量、函數(shù)或類。庫文件分為靜態(tài)庫和動態(tài)庫，靜態(tài)庫和動態(tài)庫的區(qū)別體現(xiàn)在程序的鏈接階段：靜態(tài)庫在程序的鏈接階段被復(fù)制到了程序中；動態(tài)庫在鏈接階段沒有被復(fù)制到程序中，而是程序在運行時由系統(tǒng)動態(tài)加載到內(nèi)存中供程序調(diào)用。使用動態(tài)庫系統(tǒng)只需載入一次，不同的程序可以得到內(nèi)存中相同的動態(tài)庫的副本，因此節(jié)省了很多內(nèi)存，而且使用動態(tài)庫也便于模塊化更新程序。
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