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VCS 是編譯型Verilog 模擬器，它完全支持OVI 標(biāo)準(zhǔn)的Verilog HDL 語言、PLI 和SDF。
VCS 具有目前行業(yè)中最高的模擬性能，其出色的內(nèi)存管理能力足以支持千萬門級(jí)的ASIC 設(shè)計(jì)，而其模擬精度也完全滿足深亞微米ASIC Sign-Off 的要求。VCS 結(jié)合了節(jié)拍式算法和事件驅(qū)動(dòng)算法，具有高性能、大規(guī)模和高精度的特點(diǎn)，適用于從行為級(jí)、RTL 到Sign-Off 等各個(gè)階段。VCS 已經(jīng)將CoverMeter 中所有的覆蓋率測(cè)試功能集成，并提供VeraLite、CycleC等智能驗(yàn)證方法。VCS 和Scirocco 也支持混合語言仿真。VCS 和Scirocco 都集成了Virsim圖形用戶界面，它提供了對(duì)模擬結(jié)果的交互和后處理分析。
VCS 具有目前行業(yè)中最高的模擬性能，其出色的內(nèi)存管理能力足以支持千萬門級(jí)的ASIC 設(shè)計(jì)，而其模擬精度也完全滿足深亞微米ASIC Sign-Off 的要求。VCS 結(jié)合了節(jié)拍式算法和事件驅(qū)動(dòng)算法，具有高性能、大規(guī)模和高精度的特點(diǎn)，適用于從行為級(jí)、RTL 到Sign-Off 等各個(gè)階段。VCS 已經(jīng)將CoverMeter 中所有的覆蓋率測(cè)試功能集成，并提供VeraLite、CycleC等智能驗(yàn)證方法。VCS 和Scirocco 也支持混合語言仿真。VCS 和Scirocco 都集成了Virsim圖形用戶界面，它提供了對(duì)模擬結(jié)果的交互和后處理分析。
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