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SDRAM作為大容量存儲器在高速圖像處理中具有很大的應用價值。但由于SDRAM的結構和SRAM不同，其控制比較復雜。文章詳細介紹了 SDRAM存儲器的結構、接口信號和操作方法，以及 SDRAM控制器的設計方法。結合實際系統，設計給出了使用FPGA實現 SDRAM控制器的硬件接口，在 Altera公司的主流FPGA芯片EPlC6Q240C8上，通過增加流水級數和將輸出觸發器布置在IO單元中，該控制器可達到185MHz的頻率。
在高速圖像采集和存儲系統中需要海量數據的暫時存儲，即大的中間緩存，使用 SDRAM作為數據緩存是一種非常有效的方法。 SDRAM作數據緩存不僅具有大容量和高速度的特點，而且在價格和功耗方面也占有很大的優勢。由于SDRAM的基本存儲單元是基于三極管和電容的，這與普通的基于觸發器的SRAM的存儲結構有較大差異，因此其控制機制比較復雜。雖然目前的微處理器或許多DSP都具有和 SDRAM的直接接口，但是這種接口的效率并不高，并不適合作為高速圖像存儲系統的應用。鑒于以上情況，木文介紹了在高速圖像采集和存儲系統中采用了SDRAM作為主要數據緩沖存儲器，并設計了基于FPGA的 SDRAM控制器的方法，綜合及仿真結果表明，在 Altera公司的主流芯片 Cyclone（EPlC6Q240C8）上，該 SDRAM控制器的最高頻率可達到185MH
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