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設計了以FPGA器件XCSVIXS0為核心處理芯片的高速數據采集存儲系統。在XCSVLXS0內部實現的高速狀態機和相位延遲時鐘作用下，采用4片高速A／D器件流水工作來提高數據采集速度。同時在XCSVLXS0內實現的FLASHMEMORY控制器的作用下，實現了數據在存儲器陣列的高速存儲，數據采集系統可實現百兆以上速度的實時采集存儲。
在傳統的數據采集系統中，A／D的控制和數據的轉存均通過CPU或者MCU來完成。在這種方式下，將A／D轉換的結果讀人，然后再轉存到片外的存儲器中，這一過程至少需要4個機器周期。即使對于ARM芯核的單片機（CPU采用流水線結構，1個機器周期占1個CLK），使用33 MHz的晶振，它的最高轉存數據速度也只達到8 Mbit／s．在高速采樣系統中，這種方式一方面占用太多CPU資源，另外也遠遠不能滿足高速采樣的速度要求。同時，在數據采集系統的前端數字信號處理（DSP）中，如FFr、FIR、IIR濾波等，以往一般都是利用DSP內部的硬件乘法器加軟件控制來實現。DSP的工作方式是通過內部的CPU逐條執行軟件指令來完成各種運算和邏輯功能的，在排隊式串行指令執行方式下，工作速度和效率也將降低。為了提高數字信號處理速度，現在一些實現專用算法的DSP模塊和通信接口也由FPGA或者CPLD實現。基于上述原因，設計了以Viaex一5系列的XCSVIXS0為核心處理芯片的多路數據采集系統，它以硬件電路方式來提高速度。
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