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一種高速并行位同步結(jié)構(gòu)設(shè)計(jì)研究

2017-10-30 | rar | 0.66 MB | 次下載 | 1積分

資料介紹

  隨著衛(wèi)星技術(shù)和星上有效載荷技術(shù)的發(fā)展,衛(wèi)星數(shù)傳系統(tǒng)對(duì)信息傳輸速率的要求也越來(lái)越高,從過(guò)去的kbps 提高到目前幾百M(fèi)bps,末來(lái)高速數(shù)傳系統(tǒng)傳輸速率將達(dá)G 量級(jí)。隨著傳輸速率的提升,如何實(shí)時(shí)處理高速數(shù)據(jù)成為關(guān)鍵。

  美國(guó)JPL 實(shí)驗(yàn)室在97 年提出了APRX 結(jié)構(gòu),采用并行結(jié)構(gòu)實(shí)現(xiàn)高速全數(shù)字解調(diào),國(guó)內(nèi)也有許多針對(duì)高速數(shù)據(jù)解調(diào)方面的研究|。并行結(jié)構(gòu)的解調(diào)器中的匹配濾波器個(gè)數(shù)與并行路數(shù)成比,資源消耗巨大,且位同步數(shù)據(jù)抽取需要大量選擇開(kāi)關(guān),成為FPGA 實(shí)現(xiàn)的一個(gè)難點(diǎn)。研究了并行結(jié)構(gòu)的頻域匹配濾波器設(shè)計(jì),給出了一種頻域并行解調(diào)結(jié)構(gòu)。文中將匹配濾波與位同步相結(jié)合,通過(guò)實(shí)時(shí)更新濾波器系數(shù),同時(shí)實(shí)現(xiàn)濾波、內(nèi)插、抽取功能,濾波器組輸出速率降低為符號(hào)速率。降低了并行結(jié)構(gòu)中匹配濾波器的數(shù)量,從而達(dá)到減少資源消耗的目的。給出了濾波器系數(shù)的計(jì)算過(guò)程及具體方法,分析了該結(jié)構(gòu)的資源消耗情況。

一種高速并行位同步結(jié)構(gòu)設(shè)計(jì)研究

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