FPGA之流水線練習4：設計思路
流水線設計就是將組合邏輯系統地分割，并在各個部分（分級）之間插入寄存器，并暫存中間數據的方法。目的是將一個大操作分解成若干的小操作，每一步小操作的時間較小，所以能提高頻率，各小操作能并行執行，所以能提高數據吞吐率（提高處理速度）。
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流水線設計就是將組合邏輯系統地分割，并在各個部分（分級）之間插入寄存器，并暫存中間數據的方法。目的是將一個大操作分解成若干的小操作，每一步小操作的時間較小，所以能提高頻率，各小操作能并行執行，所以能提高數據吞吐率（提高處理速度）。
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發表于 05-17 16:57
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工商網監
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