采用LDO的復位輸出作為處理器的復位控制信號
TMS320F2812/F2811/F28lO/C2812 /C2811/C2810處理器要求采用雙電源（1.8 V或1.9 V和3.3 V）為CPU、Flash、ROM、ADC以及I/O等外設供電。為了保證上電過程中所有模塊具有正確的復位狀態，要求處理器上電／掉電滿足一定的次序要求。
為滿足系統上電過程中相關引腳處于確定的狀態并簡化設計，首先應保證所有模塊的3.3V電壓（包括VDDIO、VDD3VFL、VDDA1/VDDA2/VDDAIO/AVDDREFBG）先供電，然后提供1.8 V或1.9V電壓。要求在VDDIO電壓達到2.5 V之前，1.8 V或1.9 V（VDD／VDD1）的電壓不能超過0.3 V。只有這樣才能夠保證在上電過程中，所有I/O狀態確定后內核才上電，處理器模塊上電完成后都處于一個正確的復位狀態。上電次序如圖1所示。
圖1 281x處理器上電／掉電次序時序
掉電過程中，在VDD降低到1.5 V之前，處理器的復位引腳必須插人最小8 μS的低電平。這樣有助于在VDDIO/VDD掉電之前，片上的Flash邏輯處于復位狀態。因此，電源設計時一般采用LDO的復位輸出作為處理器的復位控制信號。供電原理如圖2所示。
圖2 281x處理器供電原理圖
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