ADRV9040是具有DFE、400MHz iBW射頻收發器的8T8R SoC。ADRV9040可直接由0.8V、1.0V和1.8V穩壓器供電,并通過一個標準SPI串行端口進行控制。全面的節電模式可盡量降低正常使用時的功耗。該器件采用27mm × 20mm、736引腳球柵陣列封裝。
ADRV9040是一款高度集成的片上系統(SoC)射頻(RF)捷變收發器,配有集成式數字前端(DFE)。SoC包含8個收發器、2個用于監測發射器通道的觀測接收器、8個接收器、集成LO和時鐘合成器,以及數字信號處理功能。SoC滿足蜂窩基礎設施應用(包括小型蜂窩基站無線電、宏3G/4G/5G系統和大規模MIMO基站)所需的高射頻性能和低功耗。
寬帶收發器IC ADI ADRV9040用戶手冊文檔免費下載:
*附件:adrv9040-reference-manual-ug-2192.pdf
產品詳情
- 8個差分發送器(Tx)
- 8個差分接收器(Rx)
- 2個觀察接收器(ORx)
- 單頻段和多頻段(N x 2T2R/4T4R)能力
- 可調范圍^1^內4個波段輪廓
- 調諧范圍:650 MHz至6000 MHz
- 400MHz iBW DPD支持
- 通過硬件加速電荷捕捉糾正算法實現GaN PA支持
- 支持JESD204B/JESD204C數字接口
- 適用于所有LO和基帶時鐘的多芯片相位同步
- 完全集成的N部射頻頻率合成器
- 簡化系統散熱解決方案
- 所有區塊實現13W功耗^2^
- 110°C最高結溫,工作溫度最高達125°^3^
- 完全集成的DFE(DPD、CDUC、CDDC、CFR)引擎,免除FPGA的需要,SERDES通道速率減半
- DPD自適應引擎,實現功率放大器的線性化
- CDUC/CDDC——每個Tx/Rx通路最多8個分量載波(CC)
- 多級CFR引擎
- 完全集成的時鐘頻率合成器
^1^波段輪廓定義信道帶寬和總采樣率。
^2^使用案例是TDD 200 MHz瞬時帶寬和200 MHz占用帶寬,所有區塊(DPD、CFR、CDUC/CDDC)啟用。
^3^根據加速因子,110°C時的工作壽命影響可由<110°C時的運行補償。
應用
- 3G/4G/5G TDD/FDD小型蜂窩、大規模MIMO和宏基站
ADRV9040 用戶手冊參考總結
概述
ADRV9040 是 Analog Devices 公司生產的一款高度集成的射頻敏捷收發器,提供八個發射器、兩個觀測接收器、八個接收器以及集成的本地振蕩器和時鐘合成器等功能。本參考手冊詳細描述了該設備的硬件結構、軟件集成、配置和控制方法。
主要內容
1. 系統概述
- ?功能框圖?:詳細介紹了 ADRV904x 的功能框圖,包括發射器、接收器、本地振蕩器、時鐘合成器等主要模塊。
- ?接收器?:提供了接收器的帶通鏡像抑制、相位噪聲等關鍵性能指標的概述。
- ?發射器?:描述了發射器的架構,包括上變頻混頻器、RF 可變增益放大器等組件。
2. 軟件集成
- ?軟件交付物?:包括 API 和資源文件,用于控制收發器設備。
- ?軟件架構?:解釋了軟件的整體架構、文件夾結構以及 API 的使用方法。
- ?集成過程?:概述了軟件集成的過程,包括資源文件的生成、API 的調用等步驟。
3. API 函數
- ?主要功能?:提供了控制收發器各項功能的 API 函數,如初始化、校準、增益控制、功率測量等。
- ?錯誤處理?:描述了錯誤處理機制,包括錯誤代碼的返回和錯誤處理策略。
4. 校準
5. 增益控制和功率測量
6. 數字預失真(DPD)
7. 射頻端口阻抗匹配
- ?發射器接口?:描述了發射器 RF 端口的推薦配置和阻抗匹配方法。
- ?接收器接口?:提供了接收器 RF 端口的輸入接口電路。
8. PCB 布局考慮
- ?布局概述?:介紹了 PCB 布局的基本原則和推薦做法。
- ?堆疊和阻抗?:詳細說明了 PCB 的材料堆疊、層結構和阻抗控制。
- ?信號完整性?:提供了保持信號完整性的布局和布線指南。
9. 電源管理
- ?電源域?:描述了設備所需的四個不同電源域。
- ?電源架構?:提供了電源供應的推薦架構和布局。
10. 熱考慮
- ?熱阻值?:提供了不同封裝類型的熱阻值。
- ?熱模型?:介紹了 Delphi 緊湊熱模型,用于熱估計。
結論
ADRV9040 參考手冊為使用該設備的工程師提供了全面的指導和詳細的技術信息,涵蓋了從硬件接口到軟件控制的各個方面。通過遵循手冊中的指南和建議,用戶可以充分發揮 ADRV9040 的性能,實現高效、可靠的射頻通信系統設計。
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