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Hyperram使用注意事項總結

XL FPGA技術交流 ? 來源:XL科技 ? 作者:XL科技 ? 2023-02-01 17:07 ? 次閱讀

出于功耗的考慮,易靈思在存儲方面提供了對hyperram的支持。在hyperram中使用中有些需要注意的,我們在這里稍做總結 。

(1)IP設置

7f524cfa-a20f-11ed-bfe3-dac502259ad0.png

poYBAGPaLASAWoa9AAFmjijLAmk418.jpg

802192d0-a20f-11ed-bfe3-dac502259ad0.png

pYYBAGPaLHaAYnf6AAFWS_dic7g613.jpg

(2)IO時鐘域設置

Hyperram的IO總共有三個時鐘域,分別為hbramClk,hbramClk90,hbramClk_cal.并且要注意時鐘是否反向。在hyperram的文檔中提供了每個IO的時鐘使用情況。請參考下圖:

803958de-a20f-11ed-bfe3-dac502259ad0.png

(3)自動校準。

80638e9c-a20f-11ed-bfe3-dac502259ad0.png

注意calibration mode選擇PLLAutoCalibration.自動校準就是控制器控制hbc_cal_SHIFT_ENA,hbc_cal_SHIFT_SEL和hbc_cal_SHIIF來實現(xiàn)校正。它們分別對應PLL的SHIFT,SHIFT_SEL和SHIFT_ENA信號

自動校準的可以通過hbc_cal_debug_info來得到。通過Bit[15:8]來判斷找到的相位有哪些。bit[7:5]是用于指示選擇的是那個相位。另外要注意RDO delay值,可以獲取用于手動校準設計。

80ff341e-a20f-11ed-bfe3-dac502259ad0.png

(4)手動校準

1、在IP中選擇PLL Manual Calibration手動校準。然后編譯

2、通過手動調(diào)節(jié)dyn_pll_shase_en和dyn_pll_phase_sel,這兩個通過hbc_cal_SHIFT_ENA和hbc_cal_SHIIF傳給PLL(看起來沒有必須通過控制器傳輸?shù)谋匾?hbc_cal_SHIFT_SEL是在Hyperram控制器中選擇的PLL對應的輸出。

8125ca34-a20f-11ed-bfe3-dac502259ad0.png

其中dyn_pll_phase_en是使能信號,dyn_pll_phase_sel是step選擇信號選擇信號。

建議在資源充足的情況下使用自動校準。如果資源緊張可以先進行自動校準獲取相應參數(shù)值,再用手動校準設置相應參數(shù)。

(5)PLL設置

poYBAGPaLJiALrbrAAFFmJ1UwuM214.jpg
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8188d624-a20f-11ed-bfe3-dac502259ad0.png

(6)效率測試

以下是用hyperram測試的效率情況,僅供參考。

81c4fd16-a20f-11ed-bfe3-dac502259ad0.png

審核編輯:劉清

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原文標題:Hyperram使用指導

文章出處:【微信號:gh_ea2445df5d2a,微信公眾號:FPGA及視頻處理】歡迎添加關注!文章轉載請注明出處。

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