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高速鏈路時鐘抖動規范基礎知識

電子設計 ? 來源:網友電子設計發布 ? 作者:網友電子設計發布 ? 2021-11-22 15:52 ? 次閱讀

作者:John Johnson,德州儀器

本文介紹時鐘抖動對高速鏈路性能的影響。我們將重點介紹抖動預算基礎。

用于在更遠距離對日益增長的海量數據進行傳輸的一些標準不斷出現。來自各行業的工程師們組成了各種委員會和標準機構,根據其開發標準的目標(數據吞吐量和通信距離)確定抖動預算;同時還要考慮到組成通信鏈路的模塊的局限性。

pYYBAGGKc2uAEX5GAABqy1wyoNo165.png

圖 1 通信鏈路—抖動組件

圖 1 顯示了集成有一個嵌入式時鐘的典型高速通信鏈路。每個子系統(時鐘、發送器、通道和接收機)都會對整體抖動預算的增加產生影響。子系統抖動包括一個決定性 (DJ) 組件和一個隨機組件 (RJ),如圖 1 所示。為了實現可接受的通信效果,必須滿足下列條件:

poYBAGGKc26AEUq4AAAFxHyIi_0778.png 方程式 1

其中:TJSYS 是總抖動,而 1UI 為1個單位時間間隔(1 比特時間)

總抖動 (TJ) 包括每個子系統決定性抖動和隨機抖動的和。由于隨機抖動自身的屬性,進行這種求和時需要特別注意。隨機抖動呈現高斯(隨機)分布,并且無邊界。因此,隨機抖動可表示為一個 RMS 值,并且在規定測量/整合帶寬范圍內對其進行估算。例如,圖 1 所示接收機的抖動測量帶寬便為 f2 - f1(參見圖 2)。這是因為接收機鎖相環路 (PLL) 追蹤 f1 以下的抖動(從而排斥它),而發射 PLL 的頻率上限為 f2。從接收機的角度來看,使鏈路性能降低的隨機抖動降至這些限制之間。

pYYBAGGKc3GAfx2GAACCQ_fSkFw728.png

圖 2 高速通信鏈路—隨機抖動測量帶寬

由于隨機抖動是隨機過程產生的結果,系統總隨機抖動的計算需要進行方和根 (RSS) 計算,如方程式2所示:

poYBAGGKc3SAfP72AAAHaCjAS1I601.png

方程式 2

決定性抖動源和的計算很簡單:

pYYBAGGKc3eAM8SqAAAGOJyHLcQ677.png 方程式 3

最后,可對系統總抖動進行估算,由此可以實現鏈路預算;但是,還需要做更多的工作。這種計算涉及統計數學。需要用到一種被稱之為 Q 因數的參數(參見表 1)。Q 因數的大小具體取決于誤碼率 (BER),同時還要根據鏈路性能/可靠性目標來選擇。由于隨機抖動的無邊界屬性,(最終)會出現誤碼。例如,10-8 的 BER 意味著,每發送 100,000,000 比特便會有一個比特被錯誤解釋。現代的通信系統通常會要求一個達到或者超過 10-12 以上的 BER。

系統總抖動(以及鏈路預算)可使用方程式 4 計算得到:

poYBAGGKc3mAL-HxAAAIk96MorI556.png 方程式 4

例如,10-14 的 BER 時,總抖動為:

poYBAGGKc3yAWxA-AAAII3DhBHA153.png 方程式 5

本文討論了構成總抖動預算的一些參數。下一次,我們將探討時鐘,并研究隨機抖動和相位噪聲之間的關系。

編輯:jq

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