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單片機(jī)與FPGA CPLD總線接口邏輯設(shè)計(jì)

2009-09-22 | rar | 260 | 次下載 | 10積分

資料介紹

設(shè)計(jì)一種基于MCS-51 單片機(jī)FPGA/CPLD 的總線接口邏輯,實(shí)現(xiàn)單片機(jī)與可編程邏輯器件數(shù)據(jù)與控制信息的可靠通信,使可編程邏輯器件與單片機(jī)相結(jié)合,優(yōu)勢(shì)互補(bǔ),組成靈活的、軟硬件都可現(xiàn)場(chǎng)編程的控制系統(tǒng)。在設(shè)計(jì)中采用VHDL 語(yǔ)言,實(shí)現(xiàn)MCS-51 單片機(jī)與FPGA/CPLD 的總線接口邏輯設(shè)計(jì)。試驗(yàn)表明,該總線接口邏輯工作穩(wěn)定、可靠,使MCS-51 單片機(jī)與FPGA/CPLD 能夠完美結(jié)合。
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