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      電子發燒友網>電子資料下載>電子論文>嵌入式技術論文>Cache中Tag電路的設計

      Cache中Tag電路的設計

      2010-05-08 | rar | 163 | 次下載 | 3積分

      資料介紹

      摘要：在SoC系統中，片上緩存(Cache)的采用是解決片上處理器和片外存儲器之間速度差異的重要方法，Cache中用來存儲標記位并判斷Cache是否命中的Tag電路的設計將會影響到整個Cache的性能。本文闡述了Tag電路原理，采用write和compare兩根控制信號線，控制Tag電路在預充電，比較和加載三種狀態之間進行轉換。仿真結果表明Tag電路可以實現其功能，使系統性能得到提高。
      關鍵詞：SoC；Cache；Tag電路
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