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FPGA數(shù)字信號處理算法高效實現(xiàn)

2011-12-27 | pdf | 5.35 MB | 次下載 | 免費(fèi)

資料介紹

首先,針對圖像聲納實時性的要求和FPGA片內(nèi)資源的限制,設(shè)計了級聯(lián)和并行遞歸兩種結(jié)構(gòu)的FFT處理器。文中詳細(xì)討論了利用流水線技術(shù)和并行處理技術(shù)提高FFT處理器運(yùn)算速度的方法,并針對蝶形運(yùn)算的特點提出了一些優(yōu)化和改進(jìn)措施。
其次,分析了具有相同結(jié)構(gòu)的數(shù)字濾波和相關(guān)運(yùn)算的特點,采用了有乘法器和無乘法器兩種結(jié)構(gòu)實現(xiàn)乘累加(MAC)運(yùn)算。無乘法器結(jié)構(gòu)采用分布式算法(DA),將乘法運(yùn)算轉(zhuǎn)化為FPGA易于實現(xiàn)的查表和移位累加操作,顯著提高了運(yùn)算效率。此外,還對相關(guān)運(yùn)算的時域多MAC方法及頻域FFT方法進(jìn)行了研究。
最后,完成了圖像聲納預(yù)處理模塊。在一片EP2S60上實現(xiàn)了對160路信號的接收、濾波、正交變換以及發(fā)送等處理。實驗表明,本論文所有算法均達(dá)到了設(shè)計要求。

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