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針對超標量處理器中長周期執(zhí)行指令延遲退休及持續(xù)譯碼導致的重排序緩存（ROB）阻塞問題，提出一種指令亂序提交機制。通過設計容量可配置的多緩存指令提交結構，實現(xiàn)存儲器操作指令和ALU類型指令的分類退休，根據(jù)超標量處理器架構及性能需求對目標緩存和存儲緩存容量進行參數(shù)化配置降低流水線阻塞風險，同時利用指令目的寄存器編碼提交模式加快指令提交速率。實驗結果表明，該機制提高了單次指令提交數(shù)量，基于該機制的超標量處理器相比傳統(tǒng)基于ROB順序提交機制的超標量在減少硬件開銷的情況下平均IPC指數(shù)提升46%，相比基于值預測、亂序退休和組提交的超標量處理器平均PC指數(shù)增益為19%，綜合性能更優(yōu)。
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