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      電子發燒友網>電子資料下載>電子資料>FPGA上位機（AD輸入，串口輸出）（波形顯示、開關）

      FPGA上位機（AD輸入，串口輸出）（波形顯示、開關）

      2023-05-09 | pdf | 0.38 MB | 次下載 | 2積分

      資料介紹

      目錄 一、上位機界面  二、代碼部分 三、效果 一、上位機界面 Quartus 模塊：串口收發、AD輸入、頂層模塊 二、代碼部分 頂層模塊： module test_top(inputsys_clk, //外部50M時鐘inputsys_rst_n,//外部復位信號，低有效 //ad 輸入 input [7:0] ad_data, inputad_otr, //0:在量程范圍 
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