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在本文中，我們將探討差分信號的優勢以及這些優勢如何對您的高速設計產生積極影響。
TTL、CMOS 以及其更低電壓的同類 LVTTL 與 LVCMOS 等單端信號都是數字電路設計中的常用技術。然而，使用這些類型的信號發送技術有一些不足，其最終會限制高速設計。由于不同接地電勢和高壓擺率，單端信號在遠距離通信時運行非常吃力。針對每個信號在正負電軌間切換的單端驅動器需要一個高 ΔV/Δt，這就意味著您需要各種負載的電流 (I = CΔV/Δt)。因此，軌至軌信號（大 ΔV）的局限性就顯而易見了：需要更多的電源來實現更短的轉換時間（更小的 Δt）。那么我們應如何圍繞數字設計獲得高速信號，并避免單端信號的損耗呢？實施差分信號！
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圖 1：單端信號拓撲（左）／差分信號拓撲（右）
差分系統一般是三導線系統…
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