任何高性能ADC，尤其是射頻采樣ADC，輸入或前端的設計對于實現所需的系統級性能而言很關鍵。很多情況下，射頻采樣 ADC可以對幾百MHz的信號帶寬進行數字量化。前端可以是有源（使用放大器）也可以是無源（使用變壓器或巴倫），具體取決于系統要求。無論哪種情況，都必須謹慎選擇元器件，以便實現在目標頻段的最優ADC性能。

　　簡介

　　射頻采樣ADC采用深亞微米CMOS工藝技術制造，并且半導體器件的物理特性表明較小的晶體管尺寸支持的最大電壓也較低。因此，在數據手冊中規定的出于可靠性原因而不應超出的絕對最大電壓，將當前主流的射頻采樣ADC與之前的老器件相比，可以發現這個電壓值是變小的。在使用ADC對輸入信號進行數字量化的接收機應用中，系統設計人員必須密切關注絕對最大輸入電壓。該參數直接影響ADC 的使用壽命和可靠性。不可靠的ADC可能導致整個無線電系統無法使用，且更換成本也許非常巨大。為了抵消過壓帶來的風險，射頻采樣ADC集成了可以檢測高電平閾值的電路，允許接收機通過自動增益控制（AGC）環路調節增益來進行補償。但是，如果采用流水線型ADC，則與架構相關的固有延遲可能導致輸入暴露于高電平之下，從而可能損害 ADC輸入。本文討論了一種簡單的方法來增強AGC環路，保護ADC。

　　輸入架構

　　射頻采樣ADC可采用多種不同的設計，最常見的一種是流水線架構，該架構采用多級級聯，將模擬信號轉換為數字信號。第一級最重要，可以是緩沖或未緩沖級。選擇哪種設計取決于設計要求和性能目標。例如，一個帶緩沖器的ADC通常在頻率范圍內具有更好的SFDR性能，但功耗比不帶緩沖器的ADC更高。前端設計同樣會根據ADC是否有緩沖級而改變。沒有緩沖器的ADC需要使用額外的串聯電阻來處理輸入電荷反沖，它同樣會改善SFDR性能。圖1和圖2顯示了AD9625未緩沖和AD9680緩沖射頻采樣ADC的等效輸入電路簡化圖。為簡明起見，僅顯示單端輸入。