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電子發燒友網>電子資料下載>電子資料>如何使用模型設計實現軟件無線電的IIM和ISM

如何使用模型設計實現軟件無線電的IIM和ISM

2020-10-30 | pdf | 0.10 MB | 次下載 | 1積分

資料介紹

  盡管軟件無線電(SDR)的指導原則是“開發一次,隨處運行”,但是每當硬件發生變化時,所有開發經常要重新開始。業界已經認識到,基于文本規范的傳統開發模式已無法滿足SDR硬件和軟件的可移植性要求。這種認識促使下一代通信無線電的一個新設計方法的產生。該方法基于更高層次抽象描述,采用“基于模型的設計”思想,其核心為基于“與實現無關的模型(IIM)”和“特定實現的模型(ISM)”的可操作性規范。聯合戰術無線電系統(JTRS)的聯合項目辦公室(JPO)已經提出這些可操作規范的使用指導方針,以便能充分發揮SDR的潛能。 SDR所提供的無線電可被動態地編程,以支持不同的波形標準、提供新特性、改善系統性能,以及支持新的業務。目前SDR 發展的推動者主要是美國軍方,他們希望在SDR上實現基礎的JTRS(下一代通信系統)。SDR將讓士兵能在各種通信系統上進行通訊,并僅需通過增加軟件就可模仿任何無線電的功能。與此同時,一個開放和可互操作的框架,特別是由軟件通信架構 (SCA)定義的框架,可顯著減少設計、部署和維護將來無線電的費用。從目前來看,由于SDR的低成本優勢,許多商用無線設備廠商也逐步開始采納SDR架構。作為JTRS項目的一個重要分支,SCA提供了一個定義在各種軟、硬件之間如何實現互操作性的開放架構框架。SCA還提出一個被設計用來提供不同波形(與GSM和 802.11等標準類似)之間互操作性的核心框架(CF),這些波形作為軟件應用用在商業用途中,可被下載到任何支持SCA規范的無線電設備上。開發復雜度增加幾乎每次通信技術的重大進步都會給軟件和硬件設計工程師帶來巨大挑戰,SDR也不例外。領先的武器承包商、電子元件供應商以及系統集成商目前都在開發下一代SDR,并承諾新的SDR將使無線通信改頭換面,各種無線設備將可以相互操作,新功能的添加也將可通過軟件下載來實現。通過運行在更靈活的硬件上的軟件程序來實現無線系統與任何波形之間的通信,將是一個很大的設計挑戰。在當今的軍用或商用無線平臺中,硬件都是針對波形進行優化,特別是射頻部分更是針對無線電所工作的狹窄頻段進行優化。從專用設計轉向通用設計必然會對系統的實時性能、電源消耗和尺寸大小等方面帶來不利影響。傳統設計方法的缺點到目前為止,大多數SDR設計工程師一直使用傳統的設計方法:將系統架構師定義的規范細化為文檔,用這些文檔指導專注于信號處理或射頻工程領域的項目團隊,然后由這些團隊定義硬件、設計電路、編寫軟件、運行仿真、測試并生成大量數據,這些數據被用來驗證最終實現結果是否滿足規范要求。這種方法的一個重要問題是,許多錯誤常常要在原型階段上所有模塊可以一起測試的時候才能被檢測出來。如果產品原型不滿足規范,設計工程師必須確定問題是出自于系統需求、仿真模型、接口,還是目標處理器。因為解決問題的成本隨著設計規模的增大而不斷增加,所以目標處理器出現問題將快速增加開發成本。

  波形可移植性的關鍵挑戰雖然這些挑戰不易解決,但與多目標開發的要求相比,其難度則遜色多了。每一個主要的開發項目都必須考慮各種硬件選項,包括通用處理器(GPP)、DSPFPGA,而且硬件的選擇常常要到開發過程進入到一定階段時才能確定下來。即使硬件已經選定,設計工程師也必須對硬件升級和外形因子改變有所準備,以便能完全改變開發方向,比如從DSP轉換到FPGA。傳統的開發方法與特定硬件架構相關聯,因此為了實現一種新的硬件平臺,必須從技術規范重新開始。意識到傳統設計方法的局限性,JTRS聯合項目辦公室提出了一種新的設計方法。在該方法中,波形規范在一個可執行的 IIM(與硬件規范無關)以及一個或多個可執行的ISM(與硬件規范有關)中定義。這種方法有三個優點:首先,IIM和ISM是單個、明確、可執行的波形規范,可以在團隊、部門和承包商之間共享;其次,它們提供了一個高層次的設計視角,以進行系統級的分析和折衷,并發現潛在的設計和實現錯誤;最后,它們可降低將波形從一個無線電裝置移植到另一個無線電裝置的成本,而同時還支持性能分析、需求分析跟蹤以及高性能波形設計。 IIM包含可用來定義、表征和驗證波形行為的信息,波形行為可以被驗證和跟蹤是否滿足波形需求文檔中的要求。波形的信號流、控制流和聯網方式可以利用波形子系統邊界、子系統抖動、延時和定時要求、子系統處理要求以及信號端口采樣次數等信息來定義。可執行的IIM提供一個測試臺來驗證波形功能模塊或者系統是否滿足系統要求,并驗證它們的性能。另一方面,ISM反映了預期實現被移植到特定無線電裝置架構時的詳情。該模型包含更多將處理元件分配到各種處理器資源的信息,這可讓設計工程師詳細了解此實現。它還包括目標處理器的執行時間、延遲時間、存儲器和隊列大小的模型,這允許波形設計工程師以及后續移植工作能在系統級層次上理解資源變化帶來的影響,例如:吞吐量、抖動、延時、存儲器消耗、DC 功率和實時性能。

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