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54/74166
8 位移位寄存器（串、并行輸入，串行輸出）
簡要說明
54/74166 為 8 位移位寄存器,其主要電特性的典型值如下：
型號 fm PD
54/74166 35MHz 360mW
54/74LS166A 35MHz 100mW
當清除端（C
＿＿
L
＿＿
R＿
）為低電平時，輸出端（QH）為低電平，其余七個觸發器
也均為低電平。
當CLK INH為低電平，移位/置入控制端（SH/L
＿＿
D＿
）為低電平，并行數據輸
入端（A－H）送入數據，在 CLK上升沿作用下進行串行移位操作，數據由SER
送入。
CLK 和 CLK INH 在功能上是等價的，可以交換使用。在 CLK 為高電平時
CLK INH 才可變為高電平。
引出端符號
CLK，CLK INH 時鐘輸入端（上升沿有效）
C
＿＿
L
＿＿
R＿
清除端（低電平有效）
A－H 并行數據輸入端
SER 串行數據輸入端
QH 輸出端
SH/L
＿＿
D＿
移位控制/置入控制（低電平有效）
封裝圖與邏輯圖
8 位移位寄存器（串、并行輸入，串行輸出）
簡要說明
54/74166 為 8 位移位寄存器,其主要電特性的典型值如下：
型號 fm PD
54/74166 35MHz 360mW
54/74LS166A 35MHz 100mW
當清除端（C
＿＿
L
＿＿
R＿
）為低電平時，輸出端（QH）為低電平，其余七個觸發器
也均為低電平。
當CLK INH為低電平，移位/置入控制端（SH/L
＿＿
D＿
）為低電平，并行數據輸
入端（A－H）送入數據，在 CLK上升沿作用下進行串行移位操作，數據由SER
送入。
CLK 和 CLK INH 在功能上是等價的，可以交換使用。在 CLK 為高電平時
CLK INH 才可變為高電平。
引出端符號
CLK，CLK INH 時鐘輸入端（上升沿有效）
C
＿＿
L
＿＿
R＿
清除端（低電平有效）
A－H 并行數據輸入端
SER 串行數據輸入端
QH 輸出端
SH/L
＿＿
D＿
移位控制/置入控制（低電平有效）
封裝圖與邏輯圖
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