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隨著工藝的不斷進步，CMOS 集成電路的特征尺寸不斷縮小，工藝制造難度不斷提高，我們對靜態時序分析的要求也越來越高。傳統的分析方法如BC-WC，OCV已經無法滿足我們的需求，工藝制造帶來的工藝偏差凹（process variation） 導致電路時序評估過度悲觀，從而影響電路的整體性能。與傳統的時序分析方法相比，AOCV 方法更加精準合理。在電路設計中，降低功耗的方法有很多種，比如襯底偏置、電源門控、時鐘門控間、多閾值電壓、門級功率優化剛等等。由于功耗與工作電壓幾乎成平方關系，降低工作電壓是降低功耗較為有效的方法，但是隨著工作電壓的降低，標準單元的時序和速度會越來越差。如何能夠在滿足標準單元時序和速度的前提下，最大程度地降低工作電壓是急需解決的問題。基于此，文中在設計運用標準單元庫的過程中，運用AOCV 的時序分析方法，減少時間裕量，使得標準單元庫在滿足時序和速度的要求下降低工作電壓，從而達到降低功耗的目的。
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