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組合邏輯電路的分析、設(shè)計(jì)和調(diào)試（一）
一、實(shí)驗(yàn)?zāi)康?BR>1.進(jìn)一步熟悉數(shù)字邏輯實(shí)驗(yàn)箱的使用。
2.掌握用SSI（小規(guī)模數(shù)字集成電路）構(gòu)成的組合邏輯電路的分析與設(shè)計(jì)方法。
二、預(yù)習(xí)要求
l.預(yù)習(xí)組合邏輯電路的設(shè)計(jì)方法。
2.按設(shè)計(jì)步驟根據(jù)所給器件設(shè)計(jì)電路。
三、實(shí)驗(yàn)原理
組合邏輯電路是最常見的邏輯電路之一，其特點(diǎn)是在任一時(shí)刻的輸出信號僅取決該時(shí)刻
的輸入信號，而與信號作用前電路原來所處的狀態(tài)無關(guān)。
1.使用中、小規(guī)模集成電路來設(shè)計(jì)組合電路是最常見的邏輯電路。設(shè)計(jì)組合電路的一般
步驟如圖2.1 所示。
一、實(shí)驗(yàn)?zāi)康?BR>1.進(jìn)一步熟悉數(shù)字邏輯實(shí)驗(yàn)箱的使用。
2.掌握用SSI（小規(guī)模數(shù)字集成電路）構(gòu)成的組合邏輯電路的分析與設(shè)計(jì)方法。
二、預(yù)習(xí)要求
l.預(yù)習(xí)組合邏輯電路的設(shè)計(jì)方法。
2.按設(shè)計(jì)步驟根據(jù)所給器件設(shè)計(jì)電路。
三、實(shí)驗(yàn)原理
組合邏輯電路是最常見的邏輯電路之一，其特點(diǎn)是在任一時(shí)刻的輸出信號僅取決該時(shí)刻
的輸入信號，而與信號作用前電路原來所處的狀態(tài)無關(guān)。
1.使用中、小規(guī)模集成電路來設(shè)計(jì)組合電路是最常見的邏輯電路。設(shè)計(jì)組合電路的一般
步驟如圖2.1 所示。
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