定時器設(shè)計

　　基本要求：

　　最大為1小時，精度要求為0.01秒，當(dāng)?shù)褂嫊r間為0的時候能夠報警，要求能在數(shù)碼管上面正確顯示。

　　在完成基本要求的基礎(chǔ)上，可進(jìn)一步增加功能、提高性能。

　　計時器已有數(shù)千年歷史，從遠(yuǎn)古的日晷和漏壺到現(xiàn)在的時鐘和秒表，計時器從重量、功能、外觀、精確度、應(yīng)用范圍發(fā)生了巨大的變化。至今為止，在中國歷史上有留下記載的四代計時器分別為：日晷、沙漏、機(jī)械鐘、石英鐘。目前在中國市場上，大多數(shù)家庭使用的普通時鐘即為石英鐘。

　　本設(shè)計采用可編程芯片和Verilog HDL語言進(jìn)行軟硬件設(shè)計，不但可使硬件大為簡化，而且穩(wěn)定性明顯提高。

　　由于可編程芯片的頻率精度可達(dá)到50 MHz，因而計時精度很高。最大為1小時，精度要求為0.01秒，當(dāng)?shù)褂嫊r間為0的時候能夠報警，要求能在數(shù)碼管上面正確顯示。在完成基本要求的基礎(chǔ)上，可進(jìn)一步增加功能、提高性能。

　　系統(tǒng)需要完成的主要功能是分頻、校時、復(fù)位、計時、顯示，將其分別實現(xiàn)。定時器的核心器件為EP2C35F672C6芯片，顯示采用6個7段數(shù)碼管，采用共陽接法。

　　系統(tǒng)設(shè)計

　　分頻校時模塊是對外部來的27MHZ的頻率進(jìn)行轉(zhuǎn)化。半點整點報時模塊則是在分鐘顯示為0的時候，分別亮紅LED0。計數(shù)器模塊則是對時分秒的邏輯定義和計數(shù)。顯示模塊則包括數(shù)碼管譯碼和將OUT0到OUT6先顯示到數(shù)碼管上。設(shè)計時可將外部的時鐘信號clk輸入進(jìn)分頻模塊，此時系統(tǒng)通過分頻將輸出控制信號div，以控制秒位。而秒位產(chǎn)生的進(jìn)位信號ss則能夠控制分位。分位的進(jìn)位信號sm又能控制時位，這樣就形成了電子時鐘。在計數(shù)的同時將分秒每位輸出送到譯碼器。譯碼器模塊可對輸入的四位進(jìn)行譯碼，在6個七段數(shù)碼管上顯示出來。
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