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數(shù)字輸入和定時
該dac2900數(shù)據(jù)輸入端口接受標準數(shù)據(jù)位的D9是最顯著的編碼位（MSB）。該轉(zhuǎn)換器輸出支持時鐘頻率上升對125msps。最好的性能通常會實現(xiàn)有一個對稱的占空比寫和時鐘，但是，占空比可能隨時間變化的規(guī)格滿足。此外，設(shè)置和保持時間可以選擇在規(guī)定范圍內(nèi)。
該dac2900所有數(shù)字輸入CMOS兼容。邏輯閾值依賴于應(yīng)用的數(shù)字電源電壓，使它們被設(shè)置為大約一半的電源電壓：電壓= VD / 2（±20%耐）。的dac2900設(shè)計工作與數(shù)字電源（VD）的+3.0至5.5V。
兩器通道內(nèi)的dac2900組成兩個獨立的，10位，并行數(shù)據(jù)端口。每個DAC通道是由它自己的一套控制寫（wrt1，wrt2）（CLK1、CLK2）和時鐘輸入。在這里，WRT線控制通道輸入鎖存器和CLK線控制DAC鎖存器。數(shù)據(jù)首先加載到輸入鎖存器中一個崛起的WRT線邊緣。此數(shù)據(jù)提交給在以下的下降沿的WRT DAC鎖存器信號。在下一個上升沿的CLK線，DAC是與新的數(shù)據(jù)和模擬輸出信號將更新發(fā)生相應(yīng)的變化。雙鎖結(jié)構(gòu)dac2900結(jié)果定義的序列的WRT時鐘信號，通過參數(shù)所表達的。一個正確的時機時觀察到時鐘的上升沿發(fā)生在同一時間時間，或之前的關(guān)于信號的上升沿。這條件可以滿足連接WRT時鐘線一起。請注意，所有規(guī)格測量與WRT和時鐘線連接在一起。
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