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數(shù)字電子技術(shù)基礎(chǔ)教程本次修訂主要有以下變化：1．進(jìn)一步刪減比較陳舊和繁瑣的內(nèi)容，例如器件內(nèi)部工作原理的介紹、部分基本分析設(shè)計(jì)方法舉例等。2．引入EDA技術(shù)，并溶入到有關(guān)章節(jié)中。3．加強(qiáng)理論聯(lián)系實(shí)際，例如典型器件應(yīng)用舉例及器件選用等。
全書內(nèi)容共有7章，分別是邏輯代數(shù)與EDA技術(shù)的基礎(chǔ)知識(shí)、門電路、組合邏輯電路、觸發(fā)器、時(shí)序邏輯電路、脈沖產(chǎn)生與整形電路、數(shù)模與模數(shù)轉(zhuǎn)換電路。
第1章 邏輯代數(shù)與EDA技術(shù)的基礎(chǔ)知識(shí)
內(nèi)容提要
概述
1.1 邏輯代數(shù)的基本概念、公式和定理
1.2 邏輯函數(shù)的化簡方法
1.3 邏輯函數(shù)的表示方法及其相互之間的轉(zhuǎn)換
1.4 EDA技術(shù)的基礎(chǔ)知識(shí)
本章小結(jié)
自我檢查題
思考題與習(xí)題
第2章 門電路
內(nèi)容提要
概述
2.1 半導(dǎo)體二極管、三極管和MOS管的開關(guān)特性
2.2 分立元器件門電路
2.3 CMOS集成門電路
2.4 TTL集成門電路
2.5 門電路的VHDL描述及其仿真
本章小結(jié)
自我檢查題
思考題與習(xí)題
第3章 組合邏輯電路
內(nèi)容提要
概述
3.1 組合電路的基本分析方法和設(shè)計(jì)方法
3.2 加法器和數(shù)值比較器
3.3 編碼器和譯碼器
3.4 數(shù)據(jù)選擇器和分配器
3.5 用中規(guī)模集成電路實(shí)現(xiàn)組合邏輯函數(shù)
3.6 只讀存儲(chǔ)器
3.7 組合電路中的競爭冒險(xiǎn)
3.8 組合邏輯電路的VHDL描述及其仿真
本章小結(jié)
自我檢查題
思考題與習(xí)題
第4章 觸發(fā)器
第5章 時(shí)序邏輯電路
第6章 脈沖產(chǎn)生與整形電路
第7章 數(shù)模與模數(shù)轉(zhuǎn)換電路
參考文獻(xiàn)
內(nèi)容提要
概述
1.1 邏輯代數(shù)的基本概念、公式和定理
1.2 邏輯函數(shù)的化簡方法
1.3 邏輯函數(shù)的表示方法及其相互之間的轉(zhuǎn)換
1.4 EDA技術(shù)的基礎(chǔ)知識(shí)
本章小結(jié)
自我檢查題
思考題與習(xí)題
第2章 門電路
內(nèi)容提要
概述
2.1 半導(dǎo)體二極管、三極管和MOS管的開關(guān)特性
2.2 分立元器件門電路
2.3 CMOS集成門電路
2.4 TTL集成門電路
2.5 門電路的VHDL描述及其仿真
本章小結(jié)
自我檢查題
思考題與習(xí)題
第3章 組合邏輯電路
內(nèi)容提要
概述
3.1 組合電路的基本分析方法和設(shè)計(jì)方法
3.2 加法器和數(shù)值比較器
3.3 編碼器和譯碼器
3.4 數(shù)據(jù)選擇器和分配器
3.5 用中規(guī)模集成電路實(shí)現(xiàn)組合邏輯函數(shù)
3.6 只讀存儲(chǔ)器
3.7 組合電路中的競爭冒險(xiǎn)
3.8 組合邏輯電路的VHDL描述及其仿真
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第4章 觸發(fā)器
第5章 時(shí)序邏輯電路
第6章 脈沖產(chǎn)生與整形電路
第7章 數(shù)模與模數(shù)轉(zhuǎn)換電路
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