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SERDES是英文SERializer（串行器）/DESerializer（解串器）的簡(jiǎn)稱(chēng)。它是一種主流的時(shí)分多路復(fù)用（TDM）、點(diǎn)對(duì)點(diǎn)（P2P）的串行通信技術(shù)。即在發(fā)送端多路低速并行信號(hào)被轉(zhuǎn)換成高速串行信號(hào)，經(jīng)過(guò)傳輸媒體（光纜或銅線），最后在接收端高速串行信號(hào)重新轉(zhuǎn)換成低速并行信號(hào)。這種點(diǎn)對(duì)點(diǎn)的串行通信技術(shù)充分利用傳輸媒體的信道容量，減少所需的傳輸信道和器件引腳數(shù)目，提升信號(hào)的傳輸速度，從而大大降低通信成本。xilinx 7系列通過(guò)原語(yǔ)調(diào)用serdes接口，就可以實(shí)現(xiàn)串并（并串）轉(zhuǎn)化的應(yīng)用。
平臺(tái)：AT7 Xilinx USB3.0+LVDS+FPGA開(kāi)發(fā)板
語(yǔ)言：SystemVerilog
功能：20M時(shí)鐘產(chǎn)生8位的數(shù)據(jù)經(jīng)serdes串化，由一對(duì)LVDS輸出，再由另一對(duì)LVDS接收，經(jīng)serdes解串恢復(fù)8bit的數(shù)據(jù)。
這里，在特權(quán)的LVDS測(cè)試?yán)躺虾?jiǎn)化，只用調(diào)用原語(yǔ)serdes驗(yàn)證數(shù)據(jù)的傳輸（說(shuō)實(shí)話，特權(quán)同學(xué)的例程代碼，確實(shí)有點(diǎn)凌亂，前后看了兩天?？赡苁菍?duì)這些其中用到的原語(yǔ)不熟吧）
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