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電子發燒友網>電子資料下載>可編程邏輯>FPGA/ASIC>Cyclone V FPGA系列中文學習教程免費下載

Cyclone V FPGA系列中文學習教程免費下載

2020-07-13 | zip | 13.32 MB | 次下載 | 5積分

資料介紹

  本章節介紹了Cyclone ? V核心架構中邏輯陣列模塊(LAB)的功能特性。

  LAB是由稱作自適應邏輯模塊(ALM)的基本構造模塊組成,通過配置這些模塊能夠實現邏輯功能、算術功能以及寄存器功能。

  您可以將Cyclone V器件中1/4的LAB用作存儲器LAB (MLAB)。

  Quartus ? II軟件和所支持的第三方綜合工具,與參數化功能(例如參數化模塊庫(LPM))一起,對常用功能(例如:計數器、加法器、減法器和算術功能) 自動選擇相應的模式。

  本章節涵蓋以下兩方面內容:

  ? LAB

  ? ALM操作模式

  LAB是由一組邏輯資源組成的可配置邏輯模塊。每個LAB均包含專用邏輯,用來將控制信號驅動到ALM中。

  MLAB是LAB的超集,包含了LAB的所有特性。

  LAB控制信號

  每個LAB均包含專用邏輯,將控制信號驅動到它的ALM中,并且包含兩個獨特的時鐘源和三個時鐘使能信號。

  LAB控制模塊使用兩個時鐘源和三個時鐘使能信號生成高達三個時鐘。每個時鐘和時鐘使能信號都是相連的。

  置低時鐘使能信號會關閉相應的全LAB(LAB-wide)時鐘。

  ALM輸出

  每個ALM中的通用布線輸出驅動本地,行和列布線資源。兩個ALM輸出能驅動行、列或者直鏈布線連接,并且其中的一個ALM輸出也能夠驅動本地互聯資源。

  LUT,加法器或者寄存器輸出能驅動ALM輸出。LUT或加法器能夠驅動一個輸出,而寄存器驅動另一個輸出。

  寄存器封裝(RegisterPacking)通過將無關的寄存器和組合邏輯封裝在一個ALM中來提高器件利用率。改善布局布線的另一種機制是支持寄存器輸出驅動回相同ALM的LUT中,使寄存器與其本身的扇出LUT封裝在一起。ALM也能夠驅動寄存的LUT以及未寄存的LUT或者加法器輸出。

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