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電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>FPGA視頻教程之時序分析基礎的詳細資料說明

FPGA視頻教程之時序分析基礎的詳細資料說明

2019-03-05 | rar | 0.00 MB | 次下載 | 免費

資料介紹

  第二階段是一種功能強大的再分配式計時,它使用標準約束、分析和報告方法對您設計中的所有邏輯進行計時。在您設計的所有定時路徑中,使用II級時序的GUI或命令行界面對所有時序路徑進行重新劃分、分析和報告結(jié)果。在運行II級非標準時序之前,您必須指定描述時鐘特性、定時異常、以及相應的到達和時間的約束條件。您可以使用GUI或命令(命令),以高級設計約束(UnitedDesignContractions,簡稱DesignConstraits,簡稱二是再接邏輯的再分配,以滿足要求。

  在時序分析過程中,第二階段對設計中的路徑進行了分析,對各路徑上的傳播延遲進行了分析,檢查了各路徑上的傳播延遲,并在控制臺窗格中的報告中以松弛的形式對時序結(jié)果進行了檢測。如果再轉(zhuǎn)制時機報告違章行為,則可以自定義報告查看精確的計時特定路徑,然后再對這些路徑進行修正。設計是無時序沖突的,您可以確信邏輯符合目標設備的意圖。這是一個完整的靜態(tài)時序分析工具,您可以使用標記工具對產(chǎn)品進行再加工和再加工。

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