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介紹了QDPSK信號的優(yōu)點(diǎn)，并分析了其實現(xiàn)原理，提出一種QDPSK 高性能數(shù)字調(diào)制器的FPGA實現(xiàn)方案。采用自頂向下的設(shè)計思想，將系統(tǒng)分成串/并變換器、差分編碼器、邏輯選相電路、四相載波發(fā)生器等4大模塊，用原理圖輸入、VHDL語言設(shè)計和調(diào)用PLL核相結(jié)合的多種設(shè)計方法，分別實現(xiàn)了各模塊的具體設(shè)計，并給出了其在QuartusⅡ環(huán)境下的仿真結(jié)果。結(jié)果表明，基于PLL的QDPSK調(diào)制器，設(shè)計簡單，便于修改和調(diào)試，性能穩(wěn)定。
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