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提出了基于復雜可編程邏輯器件(Complex Programmable Logic Device, CPLD)16位的全數字脈沖信號發生器的設計，可產生周期、占空比均可調的高穩定性脈沖。此設計方法可用于DDS函數信號發生器中脈沖信號的產生，采用單片機控制CPLD工作。
- Abstract:
- ?The design of digital 16-bit pulse signal generator based on CPLD is presented,which produces period and duty factor all adjustable and high stability pulse.This method can be used as the creation of pulse in the DDS function signal generator.In the design the singlechip can control CPLD.
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