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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>用FPGA實(shí)現(xiàn)數(shù)字匹配濾波器的優(yōu)化方法

      用FPGA實(shí)現(xiàn)數(shù)字匹配濾波器的優(yōu)化方法

      2009-09-15 | rar | 177 | 次下載 | 5積分

      資料介紹

      ???????? 本文利用Xilinx公司Virtex系列器件的特殊結(jié)構(gòu)，提出了一種比較新穎的數(shù)字匹配濾波器設(shè)計(jì)方法，它在保證了該匹配濾波器與傳統(tǒng)匹配濾波器性能不變的前提下，最大限度的減少了占用的FPGA資源（與Xilinx公司推薦的設(shè)計(jì)方法相比較減少了50%以上的資源消耗）。該設(shè)計(jì)被應(yīng)用于全數(shù)字直接序列擴(kuò)頻接收機(jī)中，并取得了滿意的效果。
      關(guān)鍵詞：取樣、量化、數(shù)字匹配濾波、直接序列擴(kuò)頻
      ???????? 隨著數(shù)字技術(shù)的飛速發(fā)展，通信終端的數(shù)字化和集成化已經(jīng)成為通信技術(shù)發(fā)展的主流趨勢。在直接序列擴(kuò)頻系統(tǒng)中，數(shù)字匹配濾波器成為其實(shí)現(xiàn)的關(guān)鍵。由于傳統(tǒng)數(shù)字實(shí)現(xiàn)的匹配濾波器對資源的消耗是非常大的，即使經(jīng)過部分改進(jìn)后仍然占用了較大資源，資源消耗大成為數(shù)字匹配濾波器應(yīng)用和實(shí)現(xiàn)的瓶頸。本論文中的數(shù)字匹配濾波器結(jié)構(gòu)是在全數(shù)字?jǐn)U頻接收機(jī)的背景下提出的，設(shè)計(jì)的目的就是以最小的資源消耗實(shí)現(xiàn)接收機(jī)匹配濾波性能的要求。
      ?????????過采樣率和量化比特位數(shù)是影響數(shù)字匹配濾波器的兩個(gè)關(guān)鍵參數(shù)，為了保證匹配濾波器性能，必須合適的選擇這兩個(gè)參數(shù)。
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