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      電子發燒友網>電子資料下載>IC datasheet pdf>SN54ABT16500B,SN74ABT16500B,pd

      SN54ABT16500B,SN74ABT16500B,pd

      2010-08-21 | rar | 333 | 次下載 | 2積分

      資料介紹

      These 18-bit universal bus transceivers combine D-type latches and D-type flip-flops to allow data flow in transparent, latched, and clocked modes.

      Data flow in each direction is controlled by output-enable (OEAB and OEBA\), latch-enable (LEAB and LEBA), and clock (CLKAB\ and CLKBA\) inputs. For A-to-B data flow, the device operates in the transparent mode when LEAB is high. When LEAB is low, the A data is latched if CLKAB\ is held at a high or low logic level. If LEAB is low, the A data is stored in the latch/flip-flop on the high-to-low transition of CLKAB\. OEAB is active-high. When OEAB is high, the outputs are active. When OEAB is low, the outputs are in the high-impedance state.

      Data flow for B to A is similar to that of A to B but uses OEBA\, LEBA, and CLKBA\.

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