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This bus buffer gate is operational at 0.8-V to 2.7-V VCC, but is designed specifically for 1.65-V to 1.95-V VCC operation.
The SN74AUC1G125 is a single line driver with a 3-state output. The output is disabled when the output-enable (OE) input is high.
To ensure the high-impedance state during power up or power down, OE should be tied to VCC through a pullup resistor; the minimum value of the resistor is determined by the current-sinking capability of the driver.
NanoFree? package technology is a major breakthrough in IC packaging concepts, using the die as the package.
This device is fully specified for partial-power-down applications using Ioff. The Ioff circuitry disables the outputs, preventing damaging current backflow through the device when it is powered down.
- 具有三態輸出的單路總線緩沖器閘SN74AUC1G125數據表
- SN74AUC1G66,pdf(Single Bilater
- SN74LVC1G125-Q1,pdf(Single Bus
- SN74AUC2G125,pdf(Dual Bus Buff
- SN74AUC1G17,pdf(SINGLE SCHMITT
- SN74AUC1G126,pdf(Single Bus Bu
- SN74AUC1G07,pdf(Single Buffer/
- SN74AUC125,PDF(QUADRUPLE BUS B
- SN74AHCT1G125-Q1,pdf(Single Bu
- SN74AHCT1G125,pdf(SINGLE BUS B
- SN74AHC1G125，PDF（SINGLE BUS BU
- SN74AUC1G240,pdf(Single Buffer
- SN74AUC1G14,pdf(Single Schmitt
- SN74AUC1G06,pdf(Single Inverte
- SN74AUC1G04,pdf(Single Inverte
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