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電子發燒友網>電子資料下載>DSP>高速DSP系統詳細設計過程和設計中許多挑戰的建議詳細資料概述

高速DSP系統詳細設計過程和設計中許多挑戰的建議詳細資料概述

2018-05-04 | rar | 3.36 MB | 次下載 | 免費

資料介紹

  本文件包含以下章節:

  ·第1章介紹了高速DSP音頻視頻通信系統所面臨的挑戰。

  ·第2章提供了高速DSP系統中傳輸線的信息

  ·第3章提供了DSP系統中噪聲的相關信息。

  ·第4章介紹了高速DSP電源設計的相關信息。

  ·第5章提供了關于印刷電路板發展的信息。

  ·第6章給出了鎖相環與內、外噪聲隔離的信息。

  ·第7章提供了高速DSP系統中的電磁干擾信息。

  ·第8章總結了高速DSP系統的復雜操作。

  今天的數字信號處理器(DSP)通常運行在1GHz的內部時鐘速率,而發送和接收信號與外部設備的運行速率高于200兆赫。這些快速切換信號產生相當數量的噪聲和輻射,這會降低系統性能并產生電磁干擾(EMI)問題,這使得通過聯邦通信委員會(FCC)獲得認證所需的測試變得困難。良好的高速系統設計要求在動態負載條件下具有低開關噪聲的魯棒電源,高速信號跡線之間的最小串擾,高低頻解耦技術,以及具有最小傳輸線效應的良好信號完整性。本文提供了高速DSP系統設計中許多挑戰的建議。

高速DSP系統詳細設計過程和設計中許多挑戰的建議詳細資料概述

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