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論基于candence的組裝清單做法資料下載

1321194 2018-02-05 | pdf | 561KB | 次下載 | 1積分

資料介紹

CANDENCE是常用的繪制原理圖與PCB的EDA工具之一，它幾乎可以完成電子設計的方方面面，包括ASIC設計，FPGA設計，PCB設計等。今天我們來聊聊Cadence軟件中使用中關于原理圖的組裝清單做法。附件是我對cadence組裝清單的制作方法總結，對比，以及我居于公司現階段條件做的改進方法。在原理圖1頁到40頁的樣子，一個完整的組裝清單制作大約30min時間。

1 前言

CANDENCE 是常用的繪制原理圖與 PCB 的 EDA 工具之一，它幾乎可以完成電子設計的方方面面，包括 ASIC 設計，FPGA 設計，PCB 設計等。今天我們來聊聊 Cadence 軟件中使用中關于原理圖的組裝清單做法。 2 通常的組裝清單做法 2.1 方法一通常的組裝清單做法是導出 boom 單，然后復制其中內容到相應的表格中，再添加其他相關信息。具體步驟如下： a) 依次（1,2,3）點圖 1 中的相應位置，導出 boom 單； b) 將 boom 單中的需要信息（型號，數量，位號等）復制到對應組裝清單表格中，生成的 boom 樣子如圖 2； c) 再填上組裝清單上缺的信息欄，組裝清單的格式示例如圖 3；

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2.2 方法二

方法二的操作步驟和方法一基本一致，唯一的區別在于在建元器件原理圖封裝時將組裝清單格式中需要的信息全部做進去。封裝信息建立的方法如下： a) 常規建立好封裝之后，雙擊器件出來 user properties 界面，如圖 4； b) 在 user properties 中點擊 new,添加想添加的信息； c) 點擊 ok 完成；