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設計了一種基于DSP+CPLD構架的電能質量監測裝置，該裝置利用CPLD產生DSP外圍器件的控制時序，丈中詳細介紹了CPLD對DSP外圍器件的邏輯接口設計，通過MAX+PLUSII對CPLD的控制時序進行仿真，仿真結果驗證了本設計的可行性，試驗測試結果表明該裝置實現了多項電能質量指標的實時在線監測。
系統硬件結構設計
系統的硬件結構如圖1所示。本裝置的任務是完成對被監測信號的模數轉換和各相電能質量指標的分析計算、存儲和上傳。硬件系統包括A／D轉換單元、數字處理單元（DSP）、外擴程序空間（SRAM）、外擴數據儲存單元（FLASH）、邏輯控制單元（CPLD）、異步通信接口單元（TLl6C550）、人機接口（按鍵、液晶顯示）。
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