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摘 要: 本論文提出一種基于TMS320C6701 DSP實(shí)現(xiàn)HDTV信源解碼器的方案。用C6701實(shí)現(xiàn)系統(tǒng)控制、解復(fù)用、AC-3音頻解碼，用STi7000視頻解碼。與現(xiàn)有的HDTV信源解碼方案相比，本方案將核心芯片由三片(系統(tǒng)控制+解復(fù)用、視頻解碼和音頻解碼)減少到兩片，有利于系統(tǒng)集成，代表了HDTV信源解碼器的發(fā)展方向之一。
引言
數(shù)字高清晰度電視（HDTV）是繼黑白電視和彩色電視之后的新一代電視，HDTV接收機(jī)或機(jī)頂盒具有廣闊市場和巨大經(jīng)濟(jì)效益，已經(jīng)成為國際高科技領(lǐng)域研究開發(fā)的熱點(diǎn)之一。
HDTV接收系統(tǒng)由信道解碼、信源解碼、顯示終端組成。目前，多數(shù)HDTV信源解碼方案均由三片或三片以上的核心芯片組成，分別用于系統(tǒng)控制+解復(fù)用、視頻解碼、音頻解碼。為了提高系統(tǒng)的集成度，信源解碼方案正向著兩片方案過渡，最終可能實(shí)現(xiàn)單片解碼方案。本文提出一種兩片解碼方案：用TI的TMS320C6701完成系統(tǒng)控制、解復(fù)用、音頻解碼；用STi7000完成視頻解碼。
圖1 信源解碼器硬件框圖
圖2 信源解碼器軟件結(jié)構(gòu)框圖
圖3 軟件解碼數(shù)據(jù)流圖
硬件設(shè)計
本信源解碼方案的硬件設(shè)計如圖1所示。
系統(tǒng)的核心為TMS320C6701 DSP，采用EPROM固化系統(tǒng)程序。C6701配接SDRAM用來存儲數(shù)據(jù)和工作程序。FIFO1用來輸入TS。視頻解碼器STi7000映射到C6701存儲空間。STi7000配有SDRAM用來存儲視頻PES、各種圖像（解碼、參考和顯示幀圖像）及OSD數(shù)據(jù)。視頻后處理部分由THS8134 DAC、CPLD及運(yùn)放組成。系統(tǒng)本地時鐘和PWM產(chǎn)生器由FPGA實(shí)現(xiàn)，它與VCXO、RC低通濾波器一起在C6701解復(fù)用軟件配合下完成27MHz時鐘恢復(fù)。音頻解碼由C6701軟件完成。音頻輸出部分由FIFO2、一個 74LS157和三個D/A芯片組成。音頻輸出所用時鐘和控制信號也由FPGA實(shí)現(xiàn)。
系統(tǒng)控制、解復(fù)用和音頻解碼
C6701是TI的高性能浮點(diǎn)DSP，時鐘為167MHz，具有1336MIPS能力。C6701的Memory Map選為Map0。在其存儲器的 CE0 空間中放置了1M*32位的SDRAM。在CE1空間放置了1M*16位EPROM。本系統(tǒng)使用ROM boot process，因此C6701的BOOTMODE[4:0] 引腳置為“10010”。C6701的程序超過64K字節(jié)，因此從0地址開始執(zhí)行的是一個Loader，它把EPROM中其他程序繼續(xù)傳送到SDRAM中。傳送完成后，CPU開始從Loader以下的地址開始執(zhí)行程序。CE2空間用來放置異步器件，此時它的大小為4Mbytes。它被GAL內(nèi)部的譯碼器等分為四個部分。前兩個部分放置STi7000；第三部分放置FIFO1；第四部分放置實(shí)現(xiàn)本地時鐘和PWM的FPGA。CE3空間僅放置FIFO2。
C6701 PLL模式被選為 *4 , 即輸入引腳CLKMODE[1:0] = 11b。41.75MHz由5V晶體振蕩器產(chǎn)生，經(jīng)過LVT125做電平變換后輸入給C6701。C6701的SDCLK輸出加給零延遲時鐘緩沖器CY2308后分兩路分別提供給SDRAM。C6701所用的3.3V（VCC3）和1.9V（VCC1.9）由PT6921產(chǎn)生。本系統(tǒng)有一個 14腳插座, 它可與XDS510 emulator(硬件仿真器)連接起來實(shí)現(xiàn)仿真。C6701的HPI和串口1不被使用，相應(yīng)引腳與跳線連接，以便系統(tǒng)功能擴(kuò)展時使用。
本系統(tǒng)輸入為并行TS，輸入接口由TS數(shù)據(jù)(TSData[7:0])，DVALID，BCLK and ERROR組成。當(dāng)TS數(shù)據(jù)輸入達(dá)到2KB時，F(xiàn)IFO的/HF信號有效，它作為一個中斷信號加給C6701 INT6腳。接到此中斷后，C6701運(yùn)行有關(guān)中斷子程序，DMA將2KB TS數(shù)據(jù)取出傳輸?shù)紺6701片內(nèi)的SRAM中。該FIFO映射到C6701 EMIF CE2空間。
27MHz系統(tǒng)時鐘恢復(fù)由FPGA(EPF10K20)中的計數(shù)器/PWM模塊、外部低通濾波器和VCXO在C6701相應(yīng)軟件的控制下完成。VCXO輸出的時鐘信號輸入給FPGA中的一個42位計數(shù)器產(chǎn)生本地時鐘LMCR。當(dāng)C6701按一定算法求得PCR與本地時鐘的差值后，將此差值輸出給FPGA的PWM模塊，該模塊將此差值轉(zhuǎn)換為PWM信號后輸出給低通濾波器，取出直流后控制VCXO輸出頻率。經(jīng)一定時間的調(diào)整后，得到與發(fā)射方同步的27MHz。VCXO輸出的27MHz時鐘也提供給視頻解碼器使用。
視頻解碼
視頻解碼由ST公司的STi7000在C6701的相應(yīng)軟件控制下實(shí)現(xiàn)。STi7000完成如下功能：a)接收C6701傳來的視頻PES并進(jìn)行句法分析，取出ES存入SDRAM，取出DTS、PTS存入相應(yīng)寄存器。b)找到ES中各層的開始碼并提取頭部信息，存入相應(yīng)寄存器中，發(fā)中斷給C6701。C6701讀取這些頭部信息，并據(jù)此控制解碼流水線工作。c）STi7000的核心是硬件SLICE層以下解碼流水線。它從SDRAM中讀出ES，進(jìn)行解壓縮(VLD-反掃描-IDCT-運(yùn)動補(bǔ)償)得到重構(gòu)圖像，并根據(jù)其類型(I、B或P幀)存入SDRAM相應(yīng)區(qū)內(nèi)。在流水線開始每一幀圖像解碼前，C6701要根據(jù)該幀類型等參數(shù)向STi7000發(fā)解碼命令。解碼流水線另一個重要功能是實(shí)現(xiàn)隱錯。d)視頻格式轉(zhuǎn)換：圖像輸出前，可進(jìn)行各種格式變換(水平分辨率上下變換；垂直行數(shù)上下變換；隔行(I)和逐行(P)相互變換；3：2電影下拉模式和幅型比(4：3或16：9)變換(FULL、ZOOM、LETTERBOX和SIDEBAR)。e)實(shí)現(xiàn)OSD功能。
STi7000約有110個寄存器，分為配置、控制、存儲器存取、解碼指令、顯示、OSD、時鐘/鎖相環(huán)、D1接口、PES等9類。 C6701對STi7000各寄存器的存取通過STi7000的8位微控制器接口進(jìn)行。該接口映射入C6701 EMIF CE2空間最低1MB內(nèi)。其8位數(shù)據(jù)線接到LVT16245一邊；8位地址線接LVT16244輸出邊；片選(notA_cs)接GAL相應(yīng)的輸出，讀寫(A_RnotW)接LVT16244輸出/B_AWE上。中斷請求信號(notA_IRQ)接C6701 INT4腳。C6701通過STi7000的8位并行數(shù)據(jù)接口向STi7000寫入視頻壓縮數(shù)據(jù)。該接口與上述8位微處理器接口共用8位數(shù)據(jù)線。壓縮數(shù)據(jù)請求信號接C6701 INT5腳。壓縮數(shù)據(jù)選通輸入notA_STRB則由GAL提供。
STi7000需要128Mbit的SDRAM存儲器，由兩片4*512K*32-Bit的100MHz SDRAM芯片組成。STi7000要求SDRAM具有如下特點(diǎn)：全頁Burst長度；連續(xù)Wrap；3周期CAS Latency。SDRAM和STi7000實(shí)現(xiàn)“glueless(無膠合)”連接。
本系統(tǒng)采用TI的THS8134實(shí)現(xiàn)視頻輸出D/A變換。本系統(tǒng)只實(shí)現(xiàn)HD輸出方式。STi7000的24Bit Y、Cb、Cr數(shù)字視頻信號和PIXCLK直接輸出給THS8134，產(chǎn)生模擬Y、Pb、Pr分量信號。STi7000的PIXCLK、HSYNC和VSYNC信號加給一個CPLD(EPM7128)。該CPLD控制THS8134按照相應(yīng)的標(biāo)準(zhǔn)(1080I格式對應(yīng)SMPTE274M；720P格式對應(yīng)SMPTE296M；480P格式對應(yīng)SMPTE293M；480I格式對應(yīng)SMPTE170M)分別在Y、Pb、Pr分量上疊加三電平(1080I和720P)或兩電平(480P)復(fù)合同步信號，然后經(jīng)運(yùn)算放大器放大后輸出。這四種格式由C6701 TOUT0和TOUT1輸出的Displaymode0和1選擇。
當(dāng)音頻開始輸出時，C6701先將4KB數(shù)據(jù)寫入FIFO2中。FIFO2映射入C6701 EMIF CE3空間。FIFO2的滿標(biāo)志/FF信號有效，它觸發(fā)FPGA內(nèi)相應(yīng)模塊開始工作，將音頻主時鐘12.2880MHz時鐘分頻產(chǎn)生LRCLK(左右時鐘信號，頻率48KHz)和SCLK(串行時鐘，頻率為3.072MHz)。SCLK信號作為FIFO2的讀信號，而LRCLK則作為74LS157的輸入選擇信號。當(dāng)LRCLK為高電平時，左(左環(huán)、中央聲道)數(shù)據(jù)輸出給三個DAC芯片；當(dāng)LRCLK為低電平時，右(右環(huán)、LFE)數(shù)據(jù)輸出給三個DAC芯片。MCLK、LRCLK和SCLK同時輸入給三個DAC芯片。由三個DAC輸出的5.1聲道經(jīng)放大后分別輸出。當(dāng)FIFO2中已輸出2KB數(shù)據(jù)時，其/HF無效，此信號接至C6701 INT7輸入腳，觸發(fā)該中斷。C6701執(zhí)行相應(yīng)的中斷子程序，再向FIFO2輸出2KB數(shù)據(jù)，如此循環(huán)，保證音頻信號持續(xù)輸出。
軟件設(shè)計
系統(tǒng)的軟件結(jié)構(gòu)如圖2所示。
在C6701內(nèi)部有64Kbytes的數(shù)據(jù)SRAM和64Kbytes的Cache/Program SRAM。程序SRAM經(jīng)初始化用作Cache。64K字節(jié)的片內(nèi)數(shù)據(jù)RAM被組織成兩個塊。它們的地址分別為8000 0000h到8000 7FFFh和8000 8000h到8000 FFFFh。當(dāng)CPU的Side A和Side B或者DMA控制器同時使用不同塊時，不會引起沖突。因此，同時訪問的數(shù)據(jù)位于不同塊時，不需考慮它們的地址。整個片內(nèi)數(shù)據(jù)RAM分為五個部分：TS_Buffer(4K字節(jié))用來緩沖輸入的TS；V_PES_Buffer(16K字節(jié))用來存放視頻PES； A_PES_Buffer(8K字節(jié)) 用來存放音頻PES/ES； A_Buffer(32K字節(jié)) 用來存放解壓縮后的音頻數(shù)據(jù)；剩余的部分用于緩存中間計。
算數(shù)據(jù)。每一部分Buffer又分成兩個塊，以乒乓方式使用。即一塊由CPU使用時，另一塊可以同時進(jìn)行存貯或由DMA使用。
軟件整個系統(tǒng)解碼數(shù)據(jù)流圖如圖3所示。首先FIFO1接收到的TS數(shù)據(jù)到其存儲量的一半(2KB)，發(fā)出中斷(INTa)激活DMA3。DMA3把FIFO1里一半的數(shù)據(jù)倒到C6701的片內(nèi)存儲器TS_Buffer中，并在傳輸完成時發(fā)出中斷(INTb)，INTb的中斷服務(wù)程序發(fā)出信號semPES激活解復(fù)用任務(wù)。解復(fù)用任務(wù)從片內(nèi)存儲器中取出TS數(shù)據(jù)進(jìn)行相應(yīng)處理，然后把分離出的音視頻PES數(shù)據(jù)送回片內(nèi)存儲器，當(dāng)A_PES_Buffer填充一半時，通過信號量semAudio激活音頻處理任務(wù)。音頻處理任務(wù)從A_PES_Buffer中取出音頻PES數(shù)據(jù)，解碼后存到A_Buffer。當(dāng)A_Buffer中的數(shù)據(jù)積累到一定數(shù)量時，激活DMA2。DMA2把解碼后的4KB音頻數(shù)據(jù)輸出給FIFO2，F(xiàn)IFO2的/FF信號(滿標(biāo)志)啟動音
頻數(shù)據(jù)由FIFO2的讀出。音頻輸出FIFO2半空時會發(fā)出中斷INTc，激活DMA2。DMA2把A_Buffer中的數(shù)據(jù)再傳送2KB到FIFO2去，如此繼續(xù)下去。視頻PES數(shù)據(jù)由DMA0從V_PES_Buffer不斷地倒到片外SDRAM中，當(dāng)接到STi7000請求時，激活DMA1，把SDRAM中緩存的的視頻PES數(shù)據(jù)輸出給STi7000，進(jìn)行解碼，然后，經(jīng)視頻后處理后輸出給顯示器。
解復(fù)用的功能包括：PSI分析，時鐘恢復(fù)以及對傳輸包拆包并傳給相應(yīng)的buffer(緩存器)。
視頻解碼的功能是對視頻PES進(jìn)行解壓縮，恢復(fù)出視頻流。在系統(tǒng)中，Video Driver的中斷的優(yōu)先級被設(shè)為最高。視頻解碼系統(tǒng)主要是通過中斷來觸發(fā)其它過程的進(jìn)行，中斷是視頻解碼主線，操縱著整個視頻解碼的過程。
音頻解碼的功能是對音頻PES進(jìn)行AC-3解壓縮，恢復(fù)出音頻流。音頻解碼從音頻PES包解碼開始，在6701片內(nèi)的數(shù)據(jù)存儲區(qū)中開辟A_PES_Buffer(由兩塊各4KB對稱的存儲區(qū)組成)，解復(fù)用得到的音頻PES數(shù)據(jù)以乒乓方式存儲到這兩個區(qū)域。經(jīng)過拆包PES數(shù)據(jù)得到的ES數(shù)據(jù)直接覆蓋PES數(shù)據(jù)所處區(qū)域。然后開始音頻解碼的核心計算，將解碼輸出的PCM數(shù)據(jù)格式化后存儲到片內(nèi)數(shù)據(jù)存儲區(qū)中開辟的兩塊(各16K)PCM緩沖區(qū)中，利用DMA2將其中的數(shù)據(jù)輸出給片外的FIFO。
結(jié)語
本論文提出了一種基于通用DSP C6701的HDTV信源解碼器兩片解決方案。隨著技術(shù)的進(jìn)步，將來可能會提出HDTV信源解碼器單片解決方案。即在單個功能強(qiáng)大的芯片的基礎(chǔ)上，很多工作可以由軟件控制實(shí)現(xiàn)。本論文提出的HDTV信源解碼器解決方案對于下一代HDTV信源解碼器的研制具有重要的參考價值。
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引言
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HDTV接收系統(tǒng)由信道解碼、信源解碼、顯示終端組成。目前，多數(shù)HDTV信源解碼方案均由三片或三片以上的核心芯片組成，分別用于系統(tǒng)控制+解復(fù)用、視頻解碼、音頻解碼。為了提高系統(tǒng)的集成度，信源解碼方案正向著兩片方案過渡，最終可能實(shí)現(xiàn)單片解碼方案。本文提出一種兩片解碼方案：用TI的TMS320C6701完成系統(tǒng)控制、解復(fù)用、音頻解碼；用STi7000完成視頻解碼。
圖1 信源解碼器硬件框圖
圖2 信源解碼器軟件結(jié)構(gòu)框圖
圖3 軟件解碼數(shù)據(jù)流圖
硬件設(shè)計
本信源解碼方案的硬件設(shè)計如圖1所示。
系統(tǒng)的核心為TMS320C6701 DSP，采用EPROM固化系統(tǒng)程序。C6701配接SDRAM用來存儲數(shù)據(jù)和工作程序。FIFO1用來輸入TS。視頻解碼器STi7000映射到C6701存儲空間。STi7000配有SDRAM用來存儲視頻PES、各種圖像（解碼、參考和顯示幀圖像）及OSD數(shù)據(jù)。視頻后處理部分由THS8134 DAC、CPLD及運(yùn)放組成。系統(tǒng)本地時鐘和PWM產(chǎn)生器由FPGA實(shí)現(xiàn)，它與VCXO、RC低通濾波器一起在C6701解復(fù)用軟件配合下完成27MHz時鐘恢復(fù)。音頻解碼由C6701軟件完成。音頻輸出部分由FIFO2、一個 74LS157和三個D/A芯片組成。音頻輸出所用時鐘和控制信號也由FPGA實(shí)現(xiàn)。
系統(tǒng)控制、解復(fù)用和音頻解碼
C6701是TI的高性能浮點(diǎn)DSP，時鐘為167MHz，具有1336MIPS能力。C6701的Memory Map選為Map0。在其存儲器的 CE0 空間中放置了1M*32位的SDRAM。在CE1空間放置了1M*16位EPROM。本系統(tǒng)使用ROM boot process，因此C6701的BOOTMODE[4:0] 引腳置為“10010”。C6701的程序超過64K字節(jié)，因此從0地址開始執(zhí)行的是一個Loader，它把EPROM中其他程序繼續(xù)傳送到SDRAM中。傳送完成后，CPU開始從Loader以下的地址開始執(zhí)行程序。CE2空間用來放置異步器件，此時它的大小為4Mbytes。它被GAL內(nèi)部的譯碼器等分為四個部分。前兩個部分放置STi7000；第三部分放置FIFO1；第四部分放置實(shí)現(xiàn)本地時鐘和PWM的FPGA。CE3空間僅放置FIFO2。
C6701 PLL模式被選為 *4 , 即輸入引腳CLKMODE[1:0] = 11b。41.75MHz由5V晶體振蕩器產(chǎn)生，經(jīng)過LVT125做電平變換后輸入給C6701。C6701的SDCLK輸出加給零延遲時鐘緩沖器CY2308后分兩路分別提供給SDRAM。C6701所用的3.3V（VCC3）和1.9V（VCC1.9）由PT6921產(chǎn)生。本系統(tǒng)有一個 14腳插座, 它可與XDS510 emulator(硬件仿真器)連接起來實(shí)現(xiàn)仿真。C6701的HPI和串口1不被使用，相應(yīng)引腳與跳線連接，以便系統(tǒng)功能擴(kuò)展時使用。
本系統(tǒng)輸入為并行TS，輸入接口由TS數(shù)據(jù)(TSData[7:0])，DVALID，BCLK and ERROR組成。當(dāng)TS數(shù)據(jù)輸入達(dá)到2KB時，F(xiàn)IFO的/HF信號有效，它作為一個中斷信號加給C6701 INT6腳。接到此中斷后，C6701運(yùn)行有關(guān)中斷子程序，DMA將2KB TS數(shù)據(jù)取出傳輸?shù)紺6701片內(nèi)的SRAM中。該FIFO映射到C6701 EMIF CE2空間。
27MHz系統(tǒng)時鐘恢復(fù)由FPGA(EPF10K20)中的計數(shù)器/PWM模塊、外部低通濾波器和VCXO在C6701相應(yīng)軟件的控制下完成。VCXO輸出的時鐘信號輸入給FPGA中的一個42位計數(shù)器產(chǎn)生本地時鐘LMCR。當(dāng)C6701按一定算法求得PCR與本地時鐘的差值后，將此差值輸出給FPGA的PWM模塊，該模塊將此差值轉(zhuǎn)換為PWM信號后輸出給低通濾波器，取出直流后控制VCXO輸出頻率。經(jīng)一定時間的調(diào)整后，得到與發(fā)射方同步的27MHz。VCXO輸出的27MHz時鐘也提供給視頻解碼器使用。
視頻解碼
視頻解碼由ST公司的STi7000在C6701的相應(yīng)軟件控制下實(shí)現(xiàn)。STi7000完成如下功能：a)接收C6701傳來的視頻PES并進(jìn)行句法分析，取出ES存入SDRAM，取出DTS、PTS存入相應(yīng)寄存器。b)找到ES中各層的開始碼并提取頭部信息，存入相應(yīng)寄存器中，發(fā)中斷給C6701。C6701讀取這些頭部信息，并據(jù)此控制解碼流水線工作。c）STi7000的核心是硬件SLICE層以下解碼流水線。它從SDRAM中讀出ES，進(jìn)行解壓縮(VLD-反掃描-IDCT-運(yùn)動補(bǔ)償)得到重構(gòu)圖像，并根據(jù)其類型(I、B或P幀)存入SDRAM相應(yīng)區(qū)內(nèi)。在流水線開始每一幀圖像解碼前，C6701要根據(jù)該幀類型等參數(shù)向STi7000發(fā)解碼命令。解碼流水線另一個重要功能是實(shí)現(xiàn)隱錯。d)視頻格式轉(zhuǎn)換：圖像輸出前，可進(jìn)行各種格式變換(水平分辨率上下變換；垂直行數(shù)上下變換；隔行(I)和逐行(P)相互變換；3：2電影下拉模式和幅型比(4：3或16：9)變換(FULL、ZOOM、LETTERBOX和SIDEBAR)。e)實(shí)現(xiàn)OSD功能。
STi7000約有110個寄存器，分為配置、控制、存儲器存取、解碼指令、顯示、OSD、時鐘/鎖相環(huán)、D1接口、PES等9類。 C6701對STi7000各寄存器的存取通過STi7000的8位微控制器接口進(jìn)行。該接口映射入C6701 EMIF CE2空間最低1MB內(nèi)。其8位數(shù)據(jù)線接到LVT16245一邊；8位地址線接LVT16244輸出邊；片選(notA_cs)接GAL相應(yīng)的輸出，讀寫(A_RnotW)接LVT16244輸出/B_AWE上。中斷請求信號(notA_IRQ)接C6701 INT4腳。C6701通過STi7000的8位并行數(shù)據(jù)接口向STi7000寫入視頻壓縮數(shù)據(jù)。該接口與上述8位微處理器接口共用8位數(shù)據(jù)線。壓縮數(shù)據(jù)請求信號接C6701 INT5腳。壓縮數(shù)據(jù)選通輸入notA_STRB則由GAL提供。
STi7000需要128Mbit的SDRAM存儲器，由兩片4*512K*32-Bit的100MHz SDRAM芯片組成。STi7000要求SDRAM具有如下特點(diǎn)：全頁Burst長度；連續(xù)Wrap；3周期CAS Latency。SDRAM和STi7000實(shí)現(xiàn)“glueless(無膠合)”連接。
本系統(tǒng)采用TI的THS8134實(shí)現(xiàn)視頻輸出D/A變換。本系統(tǒng)只實(shí)現(xiàn)HD輸出方式。STi7000的24Bit Y、Cb、Cr數(shù)字視頻信號和PIXCLK直接輸出給THS8134，產(chǎn)生模擬Y、Pb、Pr分量信號。STi7000的PIXCLK、HSYNC和VSYNC信號加給一個CPLD(EPM7128)。該CPLD控制THS8134按照相應(yīng)的標(biāo)準(zhǔn)(1080I格式對應(yīng)SMPTE274M；720P格式對應(yīng)SMPTE296M；480P格式對應(yīng)SMPTE293M；480I格式對應(yīng)SMPTE170M)分別在Y、Pb、Pr分量上疊加三電平(1080I和720P)或兩電平(480P)復(fù)合同步信號，然后經(jīng)運(yùn)算放大器放大后輸出。這四種格式由C6701 TOUT0和TOUT1輸出的Displaymode0和1選擇。
當(dāng)音頻開始輸出時，C6701先將4KB數(shù)據(jù)寫入FIFO2中。FIFO2映射入C6701 EMIF CE3空間。FIFO2的滿標(biāo)志/FF信號有效，它觸發(fā)FPGA內(nèi)相應(yīng)模塊開始工作，將音頻主時鐘12.2880MHz時鐘分頻產(chǎn)生LRCLK(左右時鐘信號，頻率48KHz)和SCLK(串行時鐘，頻率為3.072MHz)。SCLK信號作為FIFO2的讀信號，而LRCLK則作為74LS157的輸入選擇信號。當(dāng)LRCLK為高電平時，左(左環(huán)、中央聲道)數(shù)據(jù)輸出給三個DAC芯片；當(dāng)LRCLK為低電平時，右(右環(huán)、LFE)數(shù)據(jù)輸出給三個DAC芯片。MCLK、LRCLK和SCLK同時輸入給三個DAC芯片。由三個DAC輸出的5.1聲道經(jīng)放大后分別輸出。當(dāng)FIFO2中已輸出2KB數(shù)據(jù)時，其/HF無效，此信號接至C6701 INT7輸入腳，觸發(fā)該中斷。C6701執(zhí)行相應(yīng)的中斷子程序，再向FIFO2輸出2KB數(shù)據(jù)，如此循環(huán)，保證音頻信號持續(xù)輸出。
軟件設(shè)計
系統(tǒng)的軟件結(jié)構(gòu)如圖2所示。
在C6701內(nèi)部有64Kbytes的數(shù)據(jù)SRAM和64Kbytes的Cache/Program SRAM。程序SRAM經(jīng)初始化用作Cache。64K字節(jié)的片內(nèi)數(shù)據(jù)RAM被組織成兩個塊。它們的地址分別為8000 0000h到8000 7FFFh和8000 8000h到8000 FFFFh。當(dāng)CPU的Side A和Side B或者DMA控制器同時使用不同塊時，不會引起沖突。因此，同時訪問的數(shù)據(jù)位于不同塊時，不需考慮它們的地址。整個片內(nèi)數(shù)據(jù)RAM分為五個部分：TS_Buffer(4K字節(jié))用來緩沖輸入的TS；V_PES_Buffer(16K字節(jié))用來存放視頻PES； A_PES_Buffer(8K字節(jié)) 用來存放音頻PES/ES； A_Buffer(32K字節(jié)) 用來存放解壓縮后的音頻數(shù)據(jù)；剩余的部分用于緩存中間計。
算數(shù)據(jù)。每一部分Buffer又分成兩個塊，以乒乓方式使用。即一塊由CPU使用時，另一塊可以同時進(jìn)行存貯或由DMA使用。
軟件整個系統(tǒng)解碼數(shù)據(jù)流圖如圖3所示。首先FIFO1接收到的TS數(shù)據(jù)到其存儲量的一半(2KB)，發(fā)出中斷(INTa)激活DMA3。DMA3把FIFO1里一半的數(shù)據(jù)倒到C6701的片內(nèi)存儲器TS_Buffer中，并在傳輸完成時發(fā)出中斷(INTb)，INTb的中斷服務(wù)程序發(fā)出信號semPES激活解復(fù)用任務(wù)。解復(fù)用任務(wù)從片內(nèi)存儲器中取出TS數(shù)據(jù)進(jìn)行相應(yīng)處理，然后把分離出的音視頻PES數(shù)據(jù)送回片內(nèi)存儲器，當(dāng)A_PES_Buffer填充一半時，通過信號量semAudio激活音頻處理任務(wù)。音頻處理任務(wù)從A_PES_Buffer中取出音頻PES數(shù)據(jù)，解碼后存到A_Buffer。當(dāng)A_Buffer中的數(shù)據(jù)積累到一定數(shù)量時，激活DMA2。DMA2把解碼后的4KB音頻數(shù)據(jù)輸出給FIFO2，F(xiàn)IFO2的/FF信號(滿標(biāo)志)啟動音
頻數(shù)據(jù)由FIFO2的讀出。音頻輸出FIFO2半空時會發(fā)出中斷INTc，激活DMA2。DMA2把A_Buffer中的數(shù)據(jù)再傳送2KB到FIFO2去，如此繼續(xù)下去。視頻PES數(shù)據(jù)由DMA0從V_PES_Buffer不斷地倒到片外SDRAM中，當(dāng)接到STi7000請求時，激活DMA1，把SDRAM中緩存的的視頻PES數(shù)據(jù)輸出給STi7000，進(jìn)行解碼，然后，經(jīng)視頻后處理后輸出給顯示器。
解復(fù)用的功能包括：PSI分析，時鐘恢復(fù)以及對傳輸包拆包并傳給相應(yīng)的buffer(緩存器)。
視頻解碼的功能是對視頻PES進(jìn)行解壓縮，恢復(fù)出視頻流。在系統(tǒng)中，Video Driver的中斷的優(yōu)先級被設(shè)為最高。視頻解碼系統(tǒng)主要是通過中斷來觸發(fā)其它過程的進(jìn)行，中斷是視頻解碼主線，操縱著整個視頻解碼的過程。
音頻解碼的功能是對音頻PES進(jìn)行AC-3解壓縮，恢復(fù)出音頻流。音頻解碼從音頻PES包解碼開始，在6701片內(nèi)的數(shù)據(jù)存儲區(qū)中開辟A_PES_Buffer(由兩塊各4KB對稱的存儲區(qū)組成)，解復(fù)用得到的音頻PES數(shù)據(jù)以乒乓方式存儲到這兩個區(qū)域。經(jīng)過拆包PES數(shù)據(jù)得到的ES數(shù)據(jù)直接覆蓋PES數(shù)據(jù)所處區(qū)域。然后開始音頻解碼的核心計算，將解碼輸出的PCM數(shù)據(jù)格式化后存儲到片內(nèi)數(shù)據(jù)存儲區(qū)中開辟的兩塊(各16K)PCM緩沖區(qū)中，利用DMA2將其中的數(shù)據(jù)輸出給片外的FIFO。
結(jié)語
本論文提出了一種基于通用DSP C6701的HDTV信源解碼器兩片解決方案。隨著技術(shù)的進(jìn)步，將來可能會提出HDTV信源解碼器單片解決方案。即在單個功能強(qiáng)大的芯片的基礎(chǔ)上，很多工作可以由軟件控制實(shí)現(xiàn)。本論文提出的HDTV信源解碼器解決方案對于下一代HDTV信源解碼器的研制具有重要的參考價值。
- HDTV(50085)
- 源解碼器(5265)
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電子學(xué)習(xí)發(fā)布于 2022-11-13 19:09:36
有效的golomb解碼器設(shè)計
本文設(shè)計了一種有效的適合硬件實(shí)現(xiàn)的golomb 解碼器 ，并且完成了解碼器電路的硬件實(shí)現(xiàn)。本設(shè)計采用有限狀態(tài)機(jī)與計數(shù)器相結(jié)合的解碼結(jié)構(gòu)，并且對有限狀態(tài)機(jī)的實(shí)現(xiàn)進(jìn)行了優(yōu)化
2011-06-29 18:05:4429
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#硬聲創(chuàng)作季 帶你重新認(rèn)識一下DC300音頻解碼器。?#發(fā)燒音響?#DAC解碼器??#BRZHIFI?
解碼器音響音頻解碼器
深海狂鯊發(fā)布于 2022-11-22 02:06:06
什么是視頻解碼器_有什么用
視頻解碼器是指一個能夠?qū)?shù)字視頻進(jìn)行壓縮或者解壓縮的程序或者設(shè)備。 專業(yè)級視頻解碼器IRD2600是一種可根據(jù)用戶特殊應(yīng)用而“量身定做的” MPEG-2/DVB標(biāo)準(zhǔn)的綜合接收解碼器，IRD-2600/H提供各種專業(yè)或選定的視頻、音頻接口。
2018-03-22 15:23:2325861
25861CoreEL 4K AVC長GOP解碼器的基本介紹
Ravi C.S.描述了Xilinx Kintex-7器件上的CoreEL 4K AVC長GOP解碼器，4K AVC幀內(nèi)編解碼器，音頻 - 視頻解碼器模塊和HEVC幀內(nèi)解碼器演示。
2018-11-28 06:05:002827
2827高清解碼器的作用
高清解碼器（xunwei）的主要作用在于接收前端高清編碼圖像或網(wǎng)絡(luò)攝像頭信號并解碼，然后通過自身的各種視頻輸出接口，如HDMI、DVI、SDI、VGA、BNC輸出顯示到顯示設(shè)備上。編碼器和解碼器
2018-12-10 15:47:4312045
12045監(jiān)控解碼器作用
如今是科技快速發(fā)展的時代，監(jiān)控技術(shù)也日趨完善，視頻解碼器是監(jiān)控系統(tǒng)中比較核心的部分，以下為大家介紹一下監(jiān)控系統(tǒng)視頻解碼器的作用，可供參考。
2018-12-10 16:32:0825639
25639解碼器的工作原理
解碼器就如同一臺筆記本一樣，通過解碼器上的數(shù)據(jù)線，與汽車相關(guān)的接口對接，從而對汽車各系統(tǒng)進(jìn)行全方位的身體檢測。而且，解碼器可以在接收到車主中控鑰匙發(fā)出的信號之后，將中控鑰匙芯片的密碼計算出來，從而復(fù)制出一把新的鑰匙，頂替舊鑰匙，讓舊鑰匙失靈。
2018-12-10 16:35:5426607
26607為什么編解碼器需要解碼器模型
通常來說，視頻解碼器聲明支持某個配置文件和級別。配置文件可以指定有關(guān)比特深度和色度二次采樣的視頻格式，以及解碼器需要支持的以解碼比特流的一組編碼工具。
2020-08-10 16:50:163185
3185ADV7401：10位集成多格式SDTV/HDTV視頻解碼器和RGB圖形數(shù)字化器產(chǎn)品手冊
ADV7401：10位集成多格式SDTV/HDTV視頻解碼器和RGB圖形數(shù)字化器產(chǎn)品手冊
2021-04-22 10:15:128
8ADV7802：12位，SDTV/HDTV 3D COM濾波器，視頻解碼器，和圖形Digitizer數(shù)據(jù)Sheet
ADV7802：12位，SDTV/HDTV 3D COM濾波器，視頻解碼器，和圖形Digitizer數(shù)據(jù)Sheet
2021-04-24 19:10:088
8AD938A：雙HDMI接收機(jī)，多格式HDTV視頻解碼器和RGB圖形編碼器
AD938A：雙HDMI接收機(jī)，多格式HDTV視頻解碼器和RGB圖形編碼器
2021-04-30 18:29:413
3ADV7181D：10位、10通道、多格式SDTV/HDTV視頻解碼器和RGB圖形數(shù)字化器產(chǎn)品手冊
ADV7181D：10位、10通道、多格式SDTV/HDTV視頻解碼器和RGB圖形數(shù)字化器產(chǎn)品手冊
2021-05-27 18:58:094
4什么叫解碼器？
解碼器就是在供電側(cè)的一個電阻元件或電容元件，在安定器的12V側(cè)，串在回路中就行了，目的是防止行車電腦報警，不同的車有不同的解碼器，主要是應(yīng)對車燈功率不足及對行車電腦干擾所加的。解碼器就是個小方盒，一般材質(zhì)為塑料的，有插頭，一插就行。
2023-05-06 11:08:262893
2893HiFi音響有必要配解碼器嗎 hifi解碼器起什么作用
HiFi解碼器在音頻系統(tǒng)中起到以下幾個重要作用：
1. 解碼數(shù)字音頻信號：HiFi解碼器可以將數(shù)字音頻信號（如Dolby Digital、DTS、FLAC、ALAC等格式）解碼成模擬
2023-08-23 15:56:315902
5902- 設(shè)計技術(shù)
- 可編程邏輯
- 電源/新能源
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- 測量儀表
- 嵌入式技術(shù)
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