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正點(diǎn)原子開(kāi)拓者FPGA Qsys視頻:uCOS II消息郵箱和消息隊(duì)列

電子硬件DIY視頻 ? 來(lái)源:電子硬件DIY視頻 ? 2019-09-17 07:04 ? 次閱讀

uC/OS-II目標(biāo)是實(shí)現(xiàn)一個(gè)基于優(yōu)先級(jí)調(diào)度的搶占式的實(shí)時(shí)內(nèi)核,并在這個(gè)內(nèi)核之上提供最基本的系統(tǒng)服務(wù),如信號(hào)量,郵箱,消息隊(duì)列,內(nèi)存管理,中斷管理等。

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    分享正點(diǎn)原子FPGA開(kāi)發(fā)板全套資料

    本帖最后由 100dongdong 于 2020-5-16 23:48 編輯 正點(diǎn)原子FPGA開(kāi)拓者開(kāi)發(fā)板,Intel(Altera) FPG
    發(fā)表于 05-16 23:35

    正點(diǎn)開(kāi)拓者FPGA開(kāi)發(fā)板使用問(wèn)題

    求問(wèn)各位大佬,剛剛?cè)腴T(mén)正點(diǎn)開(kāi)拓者FPGA開(kāi)發(fā)板,用板載pcf8591采集信號(hào)發(fā)生器單一頻率正弦波,再用ip核做fft,結(jié)果和matlab上fft不一樣,請(qǐng)問(wèn)是怎么回事呢?
    發(fā)表于 01-04 09:34

    正點(diǎn)原子開(kāi)拓者FPGA Qsys視頻uCOS II信號(hào)量(2)

    μC/OS 和μC/OS-II 是專(zhuān)門(mén)為計(jì)算機(jī)的嵌入式應(yīng)用設(shè)計(jì)的, 絕大部分代碼是用C語(yǔ)言編寫(xiě)的。CPU 硬件相關(guān)部分是用匯編語(yǔ)言編寫(xiě)的、總量約200行的匯編語(yǔ)言部分被壓縮到最低限度,為的是便于移植
    的頭像 發(fā)表于 09-18 07:05 ?1431次閱讀
    <b class='flag-5'>正點(diǎn)</b><b class='flag-5'>原子</b><b class='flag-5'>開(kāi)拓者</b><b class='flag-5'>FPGA</b> <b class='flag-5'>Qsys</b><b class='flag-5'>視頻</b>:<b class='flag-5'>uCOS</b> <b class='flag-5'>II</b>信號(hào)量(2)

    正點(diǎn)原子開(kāi)拓者FPGA Qsys視頻:uC/GUI圖片/數(shù)字顯示實(shí)驗(yàn)

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    的頭像 發(fā)表于 09-18 07:04 ?1975次閱讀
    <b class='flag-5'>正點(diǎn)</b><b class='flag-5'>原子</b><b class='flag-5'>開(kāi)拓者</b><b class='flag-5'>FPGA</b> <b class='flag-5'>Qsys</b><b class='flag-5'>視頻</b>:uC/GUI圖片/數(shù)字顯示實(shí)驗(yàn)

    正點(diǎn)原子開(kāi)拓者FPGA開(kāi)發(fā)板配套視頻FPGA是什么

    正點(diǎn)原子開(kāi)拓者FPGA開(kāi)發(fā)板配套視頻
    的頭像 發(fā)表于 09-04 06:02 ?2252次閱讀
    <b class='flag-5'>正點(diǎn)</b><b class='flag-5'>原子</b><b class='flag-5'>開(kāi)拓者</b><b class='flag-5'>FPGA</b>開(kāi)發(fā)板配套<b class='flag-5'>視頻</b>:<b class='flag-5'>FPGA</b>是什么

    正點(diǎn)原子開(kāi)拓者FPGA開(kāi)發(fā)板配套視頻(1)

    正點(diǎn)原子開(kāi)拓者FPGA開(kāi)發(fā)板配套視頻
    的頭像 發(fā)表于 09-04 06:00 ?2069次閱讀
    <b class='flag-5'>正點(diǎn)</b><b class='flag-5'>原子</b><b class='flag-5'>開(kāi)拓者</b><b class='flag-5'>FPGA</b>開(kāi)發(fā)板配套<b class='flag-5'>視頻</b>(1)

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      Quartus II 是Altera公司的綜合性CPLD/FPGA開(kāi)發(fā)軟件,原理圖、VHDL、VerilogHDL以及AHDL(Altera Hardware 支持Description
    的頭像 發(fā)表于 09-19 07:07 ?3918次閱讀
    <b class='flag-5'>正點(diǎn)</b><b class='flag-5'>原子</b><b class='flag-5'>開(kāi)拓者</b><b class='flag-5'>FPGA</b><b class='flag-5'>視頻</b>:Quartus <b class='flag-5'>II</b>軟件的使用

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    的頭像 發(fā)表于 09-17 07:10 ?1468次閱讀
    <b class='flag-5'>正點(diǎn)</b><b class='flag-5'>原子</b><b class='flag-5'>開(kāi)拓者</b><b class='flag-5'>FPGA</b> <b class='flag-5'>Qsys</b><b class='flag-5'>視頻</b>:<b class='flag-5'>uCOS</b> <b class='flag-5'>II</b>任務(wù)管理與時(shí)間管理(2)

    正點(diǎn)原子開(kāi)拓者FPGA Qsys視頻uCOS II信號(hào)量

    uC/OS-II只是一個(gè)實(shí)時(shí)操作系統(tǒng)內(nèi)核,它僅僅包含了任務(wù)調(diào)度,任務(wù)管理,時(shí)間管理,內(nèi)存管理和任務(wù)間的通信和同步等基本功能。沒(méi)有提供輸入輸出管理,文件系統(tǒng),網(wǎng)絡(luò)等額外的服務(wù)。但由于uC/OS-II良好的可擴(kuò)展性和源碼開(kāi)放,這些非必須的功能完全可以由用戶(hù)自己根據(jù)需要分別實(shí)現(xiàn)
    的頭像 發(fā)表于 09-17 07:09 ?1501次閱讀
    <b class='flag-5'>正點(diǎn)</b><b class='flag-5'>原子</b><b class='flag-5'>開(kāi)拓者</b><b class='flag-5'>FPGA</b> <b class='flag-5'>Qsys</b><b class='flag-5'>視頻</b>:<b class='flag-5'>uCOS</b> <b class='flag-5'>II</b>信號(hào)量

    正點(diǎn)原子開(kāi)拓者FPGA Qsys視頻:創(chuàng)建第一個(gè)uCOS II系統(tǒng)

    μC/OS-II由Micrium公司提供,是一個(gè)可移植、可固化的、可裁剪的、占先式多任務(wù)實(shí)時(shí)內(nèi)核,它適用于多種微處理器,微控制器和數(shù)字處理芯片(已經(jīng)移植到超過(guò)100種以上的微處理器應(yīng)用中)。同時(shí),該系統(tǒng)源代碼開(kāi)放、整潔、一致,注釋詳盡,適合系統(tǒng)開(kāi)發(fā)。
    的頭像 發(fā)表于 09-17 07:06 ?1271次閱讀
    <b class='flag-5'>正點(diǎn)</b><b class='flag-5'>原子</b><b class='flag-5'>開(kāi)拓者</b><b class='flag-5'>FPGA</b> <b class='flag-5'>Qsys</b><b class='flag-5'>視頻</b>:創(chuàng)建第一個(gè)<b class='flag-5'>uCOS</b> <b class='flag-5'>II</b>系統(tǒng)

    正點(diǎn)原子開(kāi)拓者FPGA Qsys視頻uCOS II任務(wù)管理與時(shí)間管理

    μC/OS-II由Micrium公司提供,是一個(gè)可移植、可固化的、可裁剪的、占先式多任務(wù)實(shí)時(shí)內(nèi)核,它適用于多種微處理器,微控制器和數(shù)字處理芯片(已經(jīng)移植到超過(guò)100種以上的微處理器應(yīng)用中)。同時(shí)
    的頭像 發(fā)表于 09-17 07:03 ?1211次閱讀
    <b class='flag-5'>正點(diǎn)</b><b class='flag-5'>原子</b><b class='flag-5'>開(kāi)拓者</b><b class='flag-5'>FPGA</b> <b class='flag-5'>Qsys</b><b class='flag-5'>視頻</b>:<b class='flag-5'>uCOS</b> <b class='flag-5'>II</b>任務(wù)管理與時(shí)間管理

    正點(diǎn)原子開(kāi)拓者FPGA Qsys視頻:自定義IP核之?dāng)?shù)碼管(2)

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    的頭像 發(fā)表于 09-16 07:07 ?2863次閱讀
    <b class='flag-5'>正點(diǎn)</b><b class='flag-5'>原子</b><b class='flag-5'>開(kāi)拓者</b><b class='flag-5'>FPGA</b> <b class='flag-5'>Qsys</b><b class='flag-5'>視頻</b>:自定義IP核之?dāng)?shù)碼管(2)

    正點(diǎn)原子開(kāi)拓者FPGA Qsys視頻:PIO按鍵控制LED

    該課程是正點(diǎn)原子團(tuán)隊(duì)編寫(xiě),詳細(xì)講解了quartus中的qsys。也可以從我頭像點(diǎn)進(jìn)去看FPGA verilog相關(guān)的視頻
    的頭像 發(fā)表于 09-16 07:06 ?2837次閱讀
    <b class='flag-5'>正點(diǎn)</b><b class='flag-5'>原子</b><b class='flag-5'>開(kāi)拓者</b><b class='flag-5'>FPGA</b> <b class='flag-5'>Qsys</b><b class='flag-5'>視頻</b>:PIO按鍵控制LED

    正點(diǎn)原子開(kāi)拓者FPGA Qsys視頻:PIO IRQ

    該課程是正點(diǎn)原子團(tuán)隊(duì)編寫(xiě),詳細(xì)講解了quartus中的qsys。也可以從我頭像點(diǎn)進(jìn)去看FPGA verilog相關(guān)的視頻
    的頭像 發(fā)表于 09-16 07:04 ?1589次閱讀
    <b class='flag-5'>正點(diǎn)</b><b class='flag-5'>原子</b><b class='flag-5'>開(kāi)拓者</b><b class='flag-5'>FPGA</b> <b class='flag-5'>Qsys</b><b class='flag-5'>視頻</b>:PIO IRQ

    正點(diǎn)原子開(kāi)拓者FPGA Qsys視頻:Hello World

    該課程是正點(diǎn)原子團(tuán)隊(duì)編寫(xiě),詳細(xì)講解了quartus中的qsys。也可以從我頭像點(diǎn)進(jìn)去看FPGA verilog相關(guān)的視頻
    的頭像 發(fā)表于 09-12 07:09 ?3731次閱讀
    <b class='flag-5'>正點(diǎn)</b><b class='flag-5'>原子</b><b class='flag-5'>開(kāi)拓者</b><b class='flag-5'>FPGA</b> <b class='flag-5'>Qsys</b><b class='flag-5'>視頻</b>:Hello World
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