基于ZYNQ平臺的IP設計與驗證
復旦大學某ASIC實驗室研究生新生FPGA基本知識入門培訓。 主講AXI-GP和AXI-HP總線的快速實現方式。 AXI-GP的Slave模塊由我提供的腳本生成，里面的寄存器可以被ARM訪問。 AXI-HP由我提供的AXI-HP轉FIFO模塊實現。需要給這個模塊提供控制信號： 即從哪讀，讀多少個到FIFO中； 從FIFO中讀多少個數，并寫往哪里。
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發表于 09-15 10:13
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工商網監
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