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InterfaceDesinger 使用案例-v1 -DDIO用法

XL FPGA技術交流 ? 來源: XL FPGA技術交流 ? 作者: XL FPGA技術交流 ? 2024-05-20 16:30 ? 次閱讀

DDIO用法

對于輸入輸出IO很多時候會用到DDIO的用法。對于DDIO,就是時鐘的雙沿采集或者發送數據,所以必須要用到寄存器。它的設置也比較簡單,在intefaceDesigner中添加GPIO,并把register Option設置為register,另外要設置Double Data IO Option模式,分別為normal和resync。

f0cc70a8-0b41-11ef-b759-92fbcf53809c.png

下圖是易靈思的GPIO的結構。

f0e998ae-0b41-11ef-b759-92fbcf53809c.png

對應上圖我們以ODDIO為例,分別標出了reg1,reg2和reg3三個寄存 器。當OUT0為上升沿的觸發信號,即HI,OUT1為下降沿的觸發信號,即LO。當DDIO模式設置為Normal mode時,OUT1經過reg3輸出;當設置為Resync mode時OUT1經過了reg2和reg3,reg2用于對數據打一拍來對齊數據,下面是數據的輸出波形。

f0f8ee58-0b41-11ef-b759-92fbcf53809c.png

我們只需要在top模塊中添加相應信號即可以用于控制:

module DDIO_Test(...  otuputoddio_HI,  output oddio_LO,
...
);

下圖為數據輸入時的波形,分別對應 Normal和Resync mode。

f111250e-0b41-11ef-b759-92fbcf53809c.png


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