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verilog整數四則運算的位寬考量簡介

Hack電子 ? 來源:Hack電子 ? 2023-06-06 17:07 ? 次閱讀

加、減 使用補碼時,加減法可以統一,因而對加減不加區分,對有無符號也不加以區分。

為了不丟失進位,M位+N位時,設M>=N,則結果需要M+1位儲存結果

5f8838c6-0448-11ee-90ce-dac502259ad0.png

圖源:Xilinx FPGA數字信號處理設計:基礎版 (杜勇),下同

當多個數據累加時,顯然多一位存儲結果,結果能夠表示2倍(無符號數);當擁有3-4個操作數時,結果的最大值為4倍的單個操作數表示的最大值,因而增加2bit即可;類似的5-8個操作數,最大為8倍,因而增加3bit即可

5fb74c9c-0448-11ee-90ce-dac502259ad0.png

另一方面,當計算結果能夠被約束時,不加證明地,存在一個結論:多個數相加,若結果需要Nbit即可,計算的中間值也只需Nbit

5fdf1146-0448-11ee-90ce-dac502259ad0.png

上面的計算過程若按照6bit運算過程如下,結果是一致的

601ae130-0448-11ee-90ce-dac502259ad0.jpg

2、乘法

對于無符號數,N位*M位將得到N+M位的結果??梢灾庇^的證明,如下圖移位相加,N*M將移位(M-1)次,從而至少有(N+M-1)位,若加法出現進位,還需要額外1bit,共(N+M)位

6045c184-0448-11ee-90ce-dac502259ad0.png

有符號數,最高位需要表征符號,同樣進行無符號乘法,再確定符號。因而N*M的有符號數,可以看成(N-1)*(M-1)的無符號數相乘,結果需要N+M-2位,還需要增加符號位,因而總共需要N+M-1位。

3、除法

除法更為簡單,M/N,對于整數而言,N的絕對值大于等于1,因而商最大和M一樣,只需要M位就行。

4、more

當結果位寬不夠,會進行截斷,帶來丟失精度的計算結果。





審核編輯:劉清

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原文標題:verilog 整數四則運算的位寬考量

文章出處:【微信號:Hack電子,微信公眾號:Hack電子】歡迎添加關注!文章轉載請注明出處。

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